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參數(shù)資料
| 型號： | KM48S8030B |
| 廠商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 英文描述： | 2M x 8Bit x 4 Banks Synchronous DRAM(2M x 8位 x 4組同步動態(tài)RAM) |
| 中文描述： | 200萬× 8位× 4銀行同步DRAM（2米× 8位× 4組同步動態(tài)RAM）的 |
| 文件頁數(shù)： | 35/43頁 |
| 文件大?。?/td> | 625K |
| 代理商： | KM48S8030B |
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TIMING DIAGRAM - III
CMOS SDRAM
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ELECTRONICS
REV. 2 Mar. '98
Read & Write Cycle with Auto Precharge I @Burst Length=4
HIGH
Row Active
(A-Bank)
: Don't care
*Note:
¨
When Read(Write) command with auto precharge is issued at A-Bank after A and B Bank activation.
- if Read(Write) command without auto precharge is issued at B-Bank before A Bank auto precharge starts, A Bank
auto precharge will start at B Bank read command input point .
- any command can not be issued at A Bank during tRP after A Bank auto precharge starts.
Row Active
(B-Bank)
Read with
Auto Pre
charge
(A-Bank)
Write with
Auto Precharge
(A-Bank)
Row Active
(A-Bank)
BA
0
A
10
/AP
CL=2
CL=3
DQ
ADDR
CAS
RAS
CS
CKE
CLOCK
WE
DQM
Qa0
Qa1
Qb0
Qb1
Qa0
Qa1
Qb0
Qb1
Ra
Rb
Ca
Ra
Rb
Ra
Cb
Qb2
Qb3
Read without Auto
precharge(B-Bank)
Auto Precharge
Start Point
(A-Bank)*
¨
Precharge
(B-Bank)
Da0
Da1
Da0
Da1
Qb2
Qb3
Ca
Ra
BA
1
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