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參數(shù)資料
| 型號(hào)： | PM73122-BI |
| 廠商： | PMC-SIERRA INC |
| 元件分類(lèi)： | 數(shù)字傳輸電路 |
| 英文描述： | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE, PBGA352 |
| 封裝： | 35 X 35 MM, 1.51 MM HEIGHT, SBGA-352 |
| 文件頁(yè)數(shù)： | 410/489頁(yè) |
| 文件大?。?/td> | 4416K |
| 代理商： | PM73122-BI |
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RELEASED
PM73122 AAL1GATOR-32
DATASHEET
PMC-1981419
ISSUE 7
32 LINK CES/DBCES AAL1 SAR PROCESSOR
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA, INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
385
DS3:
Use the DS3 clock directly and bypass the SBI bus.
CLK_SOURCE_TX must be set to “000”.
Clock Master or Slave Mode:
The CLK_MSTR bit determines which side controls the clock. If
CLK_MSTR is ‘1’ then the local link side controls the clock, or clock
master mode. If CLK_MSTR is ‘0’ then the local link is slave to the SBI,
or clock slave mode
There is a global CLK_MSTR bit in the SBI Bus Configuration Register
(SBI_BUS_CFG_REG), which if set will forces all links to be in clock
master mode, and if clear will let it be decided on a per link basis.
There is a CLK_MSTR bit in the Extract/Insert Tributary Control
Indirect Access Data Register for configuring clock mode for each
tributary which is used when the global CLK_MSTR bit is ‘0’. In this
case, setting the CLK_MSTR bit will configure that tributary to be a
clock master and clearing the bit will configure it to be clock slave.
When in clock slave mode, the CLK_MODE field in the Extract
Tributary Control Indirect Access Data Register determines what
type of clocking is used for a particular tributary.
When in clock slave mode the clocking method can be either
monitor SBI buffer depth (using EXT_CKCTL interface), use
ClockRate field of EXT_LINKRATE, or use Phase field of
EXT_LINKRATE value passed across SBI. Phase mode is
recommended.
SBI Error Checking and Reporting
The following errors can be detected on a per link basis: FIFO overrun,
FIFO underrun, and SBI parity error. These all can be
enabled/disabled in the Insert/Extract Control Register.
Parity detection is done only on the drop bus, which is done by the
EXSBI block. Parity can be configured to be odd or even, and it is
default to be odd parity. Parity is checked at all times, including
overhead and unused tributaries. It is recommended that one of
the Physical Layer SBI devices (e.g. TEMUX) is enabled to drive
good parity at all times. (set the equivalent to the BUSMASTER
bit).
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM73123 | 8 LINK CES/DBCES AAL1 SAR |
| PM73123-PI | 8 LINK CES/DBCES AAL1 SAR |
| PM73124 | 4 Link CES/DBCES AAL1 SAR |
| PM7323 | ROUTING CONTROL, MONITORING, & POLICING 200 MBPS |
| PM7323-SI | ROUTING CONTROL, MONITORING, & POLICING 200 MBPS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM73122-BIP | 制造商:PMC-Sierra 功能描述:AAL1GATOR32 EOL270906 |
| PM73122-BI-P | 制造商:PMC-Sierra 功能描述: |
| PM73123 | 制造商:PMC 制造商全稱(chēng):PMC 功能描述:8 Link CES/DBCES AAL1 SAR |
| PM73123PI | 制造商:PMC-Sierra 功能描述: |
| PM73123-PI | 制造商:PMC 制造商全稱(chēng):PMC 功能描述:8 LINK CES/DBCES AAL1 SAR |
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