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參數(shù)資料
| 型號(hào)： | SC2200UFH-233 |
| 廠商： | National Semiconductor Corporation |
| 元件分類： | 微處理器 |
| 英文描述： | Thin Client On a Chip |
| 中文描述： | 瘦客戶機(jī)片上 |
| 文件頁(yè)數(shù)： | 397/433頁(yè) |
| 文件大?。?/td> | 3255K |
| 代理商： | SC2200UFH-233 |
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Revision 3.0
397
www.national.com
G
Electrical Specifications
(Continued)
Table 8-27. UltraDMA Data Burst Timing Parameters
Symbol
Parameter
Mode 0 (ns)
Mode 1 (ns)
Mode 2 (ns)
Min
Max
Min
Max
Min
Max
t
2CYC
Typical sustained average two cycle time
240
160
120
Two cycle time allowing for clock variations (from rising
edge to next rising edge or from falling edge to next falling
edge of STROBE)
235
156
117
t
CYC
Cycle time allowing for asymmetry and clock variations
(from STROBE edge to STROBE edge)
114
75
55
t
DS
Data setup time (at recipient)
15
10
7
t
DH
Data hold time (at recipient)
5
5
5
t
DVS
Data valid setup time at sender (from data bus being valid
until STROBE edge)
70
48
34
t
DVH
Data valid hold time at sender (from STROBE edge until
data may become invalid)
6
6
6
t
FS
First STROBE time (for device to first negate
IDE_IRDY[0:1] (DSTROBE[0:1]) from IDE_IOW[0:1]#
(STOP[0:1]) during a data in burst)
0
230
0
200
0
170
t
LI
Limited interlock time
1
1.
t
UI
, t
MLI
, and t
LI
indicate sender-to-recipient or recipient-to-sender interlocks, that is, one agent (either sender or recipi-
ent) is waiting for the other agent to respond with a signal before proceeding. t
UI
is an unlimited interlock with no maxi-
mum time value. t
MLI
is a limited time-out with a defined minimum. t
LI
is a limited time-out with a defined maximum.
0
150
0
150
0
150
t
MLI
Interlock time with minimum
1
20
20
20
t
UI
Unlimited interlock time
1
0
0
0
t
AZ
Maximum time allowed for output drivers to release (from
being asserted or negated)
10
10
10
t
ZAH
Minimum delay time required for output drivers to assert or
negate (from released state)
20
20
20
t
ZAD
0
0
0
t
ENV
Envelope time (from IDE_DACK[0:1]# to IDE_IOW[0:1]#
(STOP[0:1]) and IDE_IOR[0:1]# (HDMARDY[0:1]#) during
data out burst initiation)
20
70
20
70
20
70
t
SR
STROBE to DMARDY time (if DMARDY# is negated before
this long after STROBE edge, the recipient shall receive no
more than one additional data WORD)
50
30
20
t
RFS
Ready-to-final-STROBE time (no STROBE edges shall be
sent this long after negation of DMARDY#)
75
60
50
t
RP
Ready-to-pause time (time that recipient shall wait to ini-
tiate pause after negating DMARDY#)
160
125
100
t
IORDYZ
Pull-up time before allowing IDE_IORDY[0:1] to be
released
20
20
20
t
ZIORDY
Minimum time device shall wait before driving
IDE_IORDY[0:1]
0
0
0
T
ACK
Setup and hold times for IDE_DACK[0:1]# (before asser-
tion or negation)
20
20
20
T
SS
Time from STROBE edge to negation of IDE_DREQ[0:1]
or assertion of IDE_IOW[0:1]# (STOP[0:1]) (when sender
terminates a burst)
50
50
50
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SC2200UFH-266 | Thin Client On a Chip |
| SC246 | SILICON BIDIRECTIONAL THYRISTORS |
| SC41343DW | Encoder and Decoder Pairs |
| SC41343P | Encoder and Decoder Pairs |
| SC41344DW | Encoder and Decoder Pairs |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SC2200UFH-233B D3 | 制造商:Advanced Micro Devices 功能描述: |
| SC2200UFH-266 | 制造商:NSC 制造商全稱:National Semiconductor 功能描述:Thin Client On a Chip |
| SC2200UFH-266F 33 | 制造商:Advanced Micro Devices 功能描述:AMD Geode Processor |
| SC2203GH | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| SC220-40 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:XpressFlow 2020 Ethernet Routing Switch Chipset |
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