參數(shù)資料
型號(hào)： TMX320TCI6482ZTZ8
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號(hào)處理
英文描述： Communications Infrastructure Digital Signal Processor
中文描述： 通信基礎(chǔ)設(shè)施的數(shù)字信號(hào)處理器
文件頁(yè)數(shù)： 71/255頁(yè)
文件大小： 1893K
代理商： TMX320TCI6482ZTZ8
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www.ti.com
3.5 Device Status Register Description
TMS320TCI6482
Communications Infrastructure Digital Signal Processor
SPRS246F–APRIL 2005–REVISED MAY 2007
The device status register depicts the device configuration selected upon device reset. Once set, these
bits will remain set until a device reset. For the actual register bit names and their associated bit field
descriptions, see
Figure 3-10
and
Table 3-13
.
Note that enabling or disabling peripherals through the Peripheral Configuration Registers (PERCFG0 and
PERCFG1) does not affect the DEVSTAT register. To determine the status of peripherals following writes
to the PERCFG0 and PERCFG1 registers, read the Peripherals Status Registers (PERSTAT0 and
PERSTAT1).
31
24
Reserved
R-0000 0000
23
22
21
20
19
18
17
16
Reserved
EMIFA_EN
DDR2_EN
PCI_EN
CFGGP2
CFGGP1
CFGGP0
Reserved
R-0
R-0
R-0
R-0
R-0
R-0
R-0
R-1
15
14
13
12
11
10
9
8
SYSCLKOUT_
EN
MCBSP1_EN
PCI66
VLYNQ_EN
PCI_EEAI
MAC_SEL1
MAC_SEL0
Reserved
R-0
R-0
R-0
R-0
R-0
R-0
R-0
R-1
7
6
5
4
3
2
1
0
UTOPIA_EN
LENDIAN
HPI_WIDTH
AECLKINSEL
BOOTMODE3
BOOTMODE2
BOOTMODE1
BOOTMODE0
R-0
R-1
R-0
R-0
R-0
R-0
R-0
R-0
LEGEND:
R/W = Read/Write; R = Read only; -
x
= value after reset
Note:
The default values of the fields in the DEVSTAT register are latched from device configuration pins, as described in
Section 3.1
,
Device Configuration at Device Reset
. The default values shown here correspond to the setting dictated by the internal pullup or pulldown
resistor.
Figure 3-10. Device Status Register (DEVSTAT) - 0x02A8 0000
Table 3-13. Device Status Register (DEVSTAT) Field Descriptions
Bit
31:23
22
Field
Reserved
EMIFA_EN
Value
Description
Reserved. Read-only, writes have no effect.
EMIFA Enable (EMIFA_EN) status bit
Shows the status of whether the EMIFA peripheral pins are enabled/disabled.
EMIFA peripheral pins are disabled (default)
EMIFA peripheral pins are enabled
DDR2 Memory Controller Enable (DDR2_EN) status bit
Shows the status of whether the DDR2 Memory Controller peripheral pins are enabled/disabled.
DDR2 Memory Controller peripheral pins are disabled (default)
DDR2 Memory Controller peripheral pins are enabled
PCI Enable (PCI_EN) status bit
Shows the status of which function is enabled on the HPI/PCI and PCI/UTOPIA multiplexed pins.
HPI and UTOPIA pin functions are enabled (default)
PCI pin functions are enabled
Used as General-Purpose inputs for configuration purposes.
These pins are latched at reset. These values can be used by S/W routines for boot operations.
Reserved. Read-only, writes have no effect.
SYSCLKOUT Enable (SYSCLKOUT_EN) status bit
Shows the status of which function is enabled on the SYSCLK4/GP[1] muxed pin.
GP[1] pin function of the SYSCLK4/GP[1] pin enabled (default)
SYSCLK4 pin function of the SYSCLK4/GP[1] pin enabled
0
1
21
DDR2_EN
0
1
20
PCI_EN
0
1
19:17
CFGGP[2:0]
16
15
Reserved
SYSCLKOUT_EN
0
1
Submit Documentation Feedback
Device Configuration
71
相關(guān)PDF資料
PDF描述
TMX320TCI6482ZTZA Communications Infrastructure Digital Signal Processor
TMX320TCI6482ZTZA8 Communications Infrastructure Digital Signal Processor
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