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參數(shù)資料
| 型號： | VCT3801A |
| 廠商： | MICRONAS SEMICONDUCTOR HOLDING AG |
| 英文描述： | Video/Controller/Teletext IC Family |
| 中文描述： | 視頻/控制/圖文電視IC系列 |
| 文件頁數(shù)： | 86/172頁 |
| 文件大?。?/td> | 2243K |
| 代理商： | VCT3801A |
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VCT 38xxA
ADVANCE INFORMATION
86
Micronas
5. TV Controller
5.1. Introduction
The TV controller basically consists of the CPU, RAM,
ROM, and a number of peripheral modules.
For instance:
– a memory banking module is included to allow
access to more than 64 kB memory.
– a bootloader software is included to allow in-system-
downloading of external code to Flash memory via
the I
2
C interface.
The TV controller runs the complete software neces-
sary to control a TV set. The software includes control
of the audio, video, OSD, and text processors on chip,
as well, as control of external devices like tuner or ste-
reo decoder.
Communication between the TV controller and exter-
nal devices is done either via I
2
C bus interface or via
programmable port pins.
The TV Controller is clocked with f
OSC
= f
XTAL
/2.
5.2. CPU
The CPU is fully compatible to WDC’s W65C02 micro-
processor. The processor has 8-bit registers/accumu-
lator, an 8-bit data bus, and a 16-bit address bus. For
further information about the CPU core, please refer to
the WDC W65C02 data sheet.
5.2.1. CPU Slow Mode
To reduce power consumption considerably, the user
can reduce the internal CPU clock frequency to 1/256
of the normal f
CPU
value. In this CPU Slow mode, pro-
gram execution is reduced to 1/256 of the normal
speed, but clocking of most other modules remains
unaffected. The modules that are affected by CPU
Slow mode are:
1. CPU and Interrupt Controller with all internal and
external interrupts
2. RAM, ROM and DMA
3. Watchdog
Some modules must not be operated during CPU Slow
mode. Refer to module sections for details.
After reset the CPU is in Fast mode (f
CPU
= f
OSC
).
CPU Slow mode is enabled by clearing flag CPUFST
in standby register SR1. The CPU clock frequency
reduction to f
OSC
/256 will take effect after a maximum
delay of 256 f
OSC
periods.
Returning CPU to Fast mode is done by setting flag
CPUFST to High. The CPU clock frequency will imme-
diately change to its normal f
OSC
value.
Fig. 5–1 shows the memory access signals during
CPU fast and slow mode.
Fig. 5–1:
Memory access signals
f
OSC
PH2
RW
WE
OE
fast mode
slow mode
CCUPH2
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VCU2133 | High-Speed coder/decoder IC |
| VCX2150A | Surface mount 15.88 mm SQ (.625 SQ) |
| VCX2154A | Surface mount 15.88 mm SQ (.625 SQ) |
| VCXO-105N | VCXO |
| VCXO-199 | VCXO |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| VCT3802A | 制造商:MICRONAS 制造商全稱:MICRONAS 功能描述:Video/Controller/Teletext IC Family |
| VCT3803A | 制造商:MICRONAS 制造商全稱:MICRONAS 功能描述:Video/Controller/Teletext IC Family |
| VCT3804A | 制造商:MICRONAS 制造商全稱:MICRONAS 功能描述:Video/Controller/Teletext IC Family |
| VCT3811A | 制造商:MICRONAS 制造商全稱:MICRONAS 功能描述:Video/Controller/Teletext IC Family |
| VCT3831A | 制造商:MICRONAS 制造商全稱:MICRONAS 功能描述:Video/Controller/Teletext IC Family |
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