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參數(shù)資料
| 型號： | 56F8014 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | 16-bit Digital Signal Controllers |
| 中文描述： | 16位數(shù)字信號控制器 |
| 文件頁數(shù)： | 55/124頁 |
| 文件大?。?/td> | 1878K |
| 代理商： | 56F8014 |
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Register Descriptions
56F8014 Technical Data, Rev. 3
Freescale Semiconductor
Preliminary
55
5.6.5.4
ADC Zero Crossing or Limit Error Interrupt Priority Level
(ADC_ZC_LE IPL)— Bits 3–2
This field is used to set the interrupt priority level for IRQs. This IRQ is limited to priorities 0 through 2.
They are disabled by default.
00 = IRQ disabled (default)
01 = IRQ is priority level 0
10 = IRQ is priority level 1
11 = IRQ is priority level 2
5.6.5.5
ADCB Conversion Complete Interrupt Priority Level
(ADCB_CC IPL)—Bits 1–0
This field is used to set the interrupt priority level for IRQs. This IRQ is limited to priorities 0 through 2.
They are disabled by default.
00 = IRQ disabled (default)
01 = IRQ is priority level 0
10 = IRQ is priority level 1
11 = IRQ is priority level 2
5.6.6
Vector Base Address Register (VBA)
Figure 5-8 Vector Base Address Register (VBA)
5.6.6.1
This bit field is reserved or not implemented. It is read as 0 and cannot be modified by writing.
Reserved—Bits15—14
5.6.6.2
The value in this register is used as the upper 14 bits of the interrupt vector VAB[20:0]. The lower 7 bits
are determined based on the highest priority interrupt and are then appended onto VBA before presenting
the full VAB to the Core.
Vector Address Bus (VAB)—Bits 13—0
5.6.7
Fast Interrupt Match 0 Register (FIM0)
Figure 5-9 Fast Interrupt Match 0 Register (FIM0)
Base + $5
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
Write
RESET
0
0
VECTOR_BASE_ADDRESS
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
Base + $6
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
Write
RESET
0
0
0
0
0
0
0
0
0
0
FAST INTERRUPT 0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| 56F802 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:16-bit Digital Signal Controllers |
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