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參數(shù)資料
| 型號： | A3P1000-1PQ208PQ208 |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 1000000 GATES, PQFP208 |
| 封裝： | 0.50 MM PITCH, PLASTIC, QFP-208 |
| 文件頁數(shù)： | 137/608頁 |
| 文件大?。?/td> | 20486K |
| 代理商： | A3P1000-1PQ208PQ208 |
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Low-Power Modes in Actel ProASIC3/E FPGAs
v1.1
2 - 3
User Low Static (Idle) Mode
User Low Static (Idle) mode is an advanced feature supported by ProASIC3/E devices to reduce static
(idle) power consumption. Entering and exiting this mode is made possible using the ULSICC macro
by setting its value to disable/enable the User Low Static (Idle) mode. Under typical operating
conditions, characterization results show up to 25% reduction of the static (idle) power
consumption. The greatest power savings in terms of percentage are seen in the smaller members
of the ProASIC3 family. The active-high control signal for User Low Static (Idle) mode can be
generated by internal or external logic. When the device is operating in User Low Static (Idle)
mode, FlashROM functionality is temporarily disabled to save power. If FlashROM functionality is
needed, the device can exit User Low Static mode temporarily and re-enter the mode once the
functionality is no longer needed.
To utilize User Low Static (Idle) mode, simply instantiate the ULSICC macro (Table 2-2 on page 2-4)
in your design, and connect the input port to either an internal logic signal or a device package
pin, as illustrated in Figure 2-2 on page 2-4 or Figure 2-3 on page 2-5, respectively. The attribute is
used so the Synplify synthesis tool will not optimize the instance with no output port.
This mode can be used to lower standard static (idle) power consumption when the FlashROM
feature is not needed. Configuring the device to enter User Low Static (Idle) mode is beneficial
when the FPGA enters and exits static mode frequently and lowering power consumption as much
as possible is desired. The device is still functional, and data is retained in this state so the device
can enter and exit this mode quickly, resulting in reduced total power consumption. The device can
also stay in User Low Static mode when the FlashROM feature is not used in the device.
Figure 2-1 CCC/PLL Macro
CLKA
GLA
GLB
YB
GLC
YC
LOCK
POWERDOWN
OADIV[4:0]*
OAMUX[2:0]*
DLYGLA[4:0]*
OBDIV[4:0]*
OBMUX[2:0]*
DLYYB[4:0]*
DLYGLB[4:0]*
OCDIV[4:0]*
OCMUX[2:0]*
DLYYC[4:0]*
DLYGLC[4:0]*
FINDIV[6:0]*
FBDIV[6:0]*
FBDLY[4:0]*
FBSEL[1:0]*
XDLYSEL*
VCOSEL[2:0]*
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PDF描述 |
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| A3P1000-1PQG144M | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Military ProASIC3/EL Low-Power Flash FPGAs |
| A3P1000-1PQG144PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
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