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參數(shù)資料
| 型號： | A3P1000-1PQ208PQ208 |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 1000000 GATES, PQFP208 |
| 封裝： | 0.50 MM PITCH, PLASTIC, QFP-208 |
| 文件頁數(shù)： | 325/608頁 |
| 文件大?。?/td> | 20486K |
| 代理商： | A3P1000-1PQ208PQ208 |
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I/O Software Control in Low-Power Flash Devices
v1.1
8 - 11
Compiling the Design
During Compile, a PDC I/O constraint file can be imported along with the netlist file. If only the
netlist file is compiled, certain I/O assignments need to be completed before proceeding to Layout.
All constraints that can be entered in PDC can also be entered using ChipPlanner, I/O Attribute
Editor, and PinEditor.
There are certain rules that must be followed in implementing I/O register combining and the I/O
DDR macro (refer to the I/O Registers section of the handbook for the device that you are using
and the "DDR" section on page 8-6 for details). Provided these rules are met, the user can enable
or disable I/O register combining by using the PDC command set_io portname –register yes|no
in the I/O Attribute Editor or selecting a check box in the Compile Options dialog box (see
Figure 8-8). The Compile Options dialog box appears when the design is compiled for the first time.
It can also be accessed by choosing Options > Compile during successive runs. I/O register
combining is off by default. The PDC command overrides the setting in the Compile Options dialog
box.
Understanding the Compile Report
The I/O bank report is generated during Compile and displayed in the log window. This report lists
the I/O assignments necessary before Layout can proceed.
When Designer is started, the I/O Bank Assigner tool is run automatically if the Layout command is
executed. The I/O Bank Assigner takes care of the necessary I/O assignments. However, these
assignments can also be made manually with MVN or by importing the PDC file. Refer to the
"Assigning Technologies and VREF to I/O Banks" section on page 8-14 for further description.
The I/O bank report can also be extracted from Designer by choosing Tools > Report and setting the
Report Type to IOBank.
This report has the following tables: I/O Function, I/O Technology, I/O Bank Resource Usage, and I/O
Voltage Usage. This report is useful if the user wants to do I/O assignments manually.
Figure 8-8 Setting Register Combining During Compile
相關PDF資料 |
PDF描述 |
|---|---|
| A3P1000-1PQG208IPQ208 | FPGA, 1000000 GATES, PQFP208 |
| A3P1000-1PQG208PQ208 | FPGA, 1000000 GATES, PQFP208 |
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相關代理商/技術參數(shù) |
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| A3P1000-1PQG144I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| A3P1000-1PQG144M | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Military ProASIC3/EL Low-Power Flash FPGAs |
| A3P1000-1PQG144PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
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