參數(shù)資料
型號(hào)： DS33ZH11+
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 18/172頁(yè)
文件大?。?/td> 0K
描述： IC MAPPER ETHERNET 100CSBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 7
應(yīng)用： 數(shù)據(jù)傳輸
接口： 串行
電源電壓： 1.8V，2.5V，3.3V
封裝/外殼： 100-LFBGA，CSPBGA
供應(yīng)商設(shè)備封裝： 100-CSBGA（10x10）
包裝： 托盤
安裝類型： 表面貼裝
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DS33Z11 Ethernet Mapper
114 of 172
9.6 Ethernet Interface Registers
The Ethernet Interface registers are used to configure RMII/MII bus operation and establish the MAC parameters
as required by the user. The MAC Registers cannot be addressed directly from the Processor port. The registers
below are used to perform indirect read or write operations to the MAC registers. The MAC Status Registers are
shown in Table 9-7. Accessing the MAC Registers is described in the Section 8.14.
9.6.1 Ethernet Interface Register Bit Descriptions
Register Name:
SU.MACRADL
Register Description:
MAC Read Address Low Register
Register Address:
140h
Bit #
7
6
5
4
3
2
1
0
Name
MACRA7
MACRA6
MACRA5
MACRA4
MACRA3
MACRA2
MACRA1
MACRA0
0
Bits 0 – 7: MAC Read Address (MACRA0-7) Low byte of the MAC address. Used only for read operations.
Register Name:
SU.MACRADH
Register Description:
MAC Read Address High Register
Register Address:
141h
Bit #
7
6
5
4
3
2
1
0
Name
MACRA1
5
MACRA1
4
MACRA1
3
MACRA1
2
MACRA1
1
MACRA1
0
MACRA9
MACRA8
0
Bits 0 – 7: MAC Read Address (MACRA8-15) High byte of the MAC address. Used only for read operations.
Register Name:
SU.MACRD0
Register Description:
MAC Read Data Byte 0
Register Address:
142h
Bit #
7
6
5
4
3
2
1
0
Name
MACRD7
MACRD6
MACRD5
MACRD4
MACRD3
MACRD2
MACRD1
MACRD0
0
Bits 0 – 7: MAC Read Data 0 (MACRD0-7) One of four bytes of data read from the MAC. Valid after a read
command has been issued and the SU.MACRWC.MCS bit is zero.
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PDF描述
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