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參數(shù)資料
| 型號： | DS33ZH11+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 90/172頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAPPER ETHERNET 100CSBGA |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 7 |
| 應(yīng)用： | 數(shù)據(jù)傳輸 |
| 接口： | 串行 |
| 電源電壓： | 1.8V，2.5V，3.3V |
| 封裝/外殼： | 100-LFBGA，CSPBGA |
| 供應(yīng)商設(shè)備封裝： | 100-CSBGA（10x10） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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DS33Z11 Ethernet Mapper
24 of 172
NAME
PIN #
DS33Z11
CSBGA
(169)
PIN #
DS33ZH1
1
BGA(100)
TYPE
FUNCTION
AFCS
C10
—
I
Automatic Flow Control (Hardware Mode): When in
Hardware Mode, set high to enable automatic flow control
pause and backpressure application. In the software
mode this pin has no effect and the rate selection is
controlled by the SU.GCR register.
Note that in the 100-pin CSBGA (DS33ZH11) package,
this pin is internally tied to VDD.
SDRAM CONTROLLER
SDATA[0]
M1
H1
SDATA[1]
L2
F2
SDATA[2]
N1
J1
SDATA[3]
M2
G2
SDATA[4]
N2
K1
SDATA[5]
N4
K2
SDATA[6]
N3
J2
SDATA[7]
L4
C3
SDATA[8]
J3
D3
SDATA[9]
M3
E2
SDATA[10]
H3
C2
SDATA[11]
J1
F1
SDATA[12]
J2
G1
SDATA[13]
K1
D1
SDATA[14]
K2
D2
SDATA[15]
L1
E1
SDATA[16]
M12
K6
SDATA[17]
H11
G7
SDATA[18]
M11
J7
SDATA[19]
N13
K8
SDATA[20]
N11
K7
SDATA[21]
L13
J8
SDATA[22]
N12
H7
SDATA[23]
K13
K9
SDATA[24]
J13
J9
SDATA[25]
J12
H8
SDATA[26]
H13
H9
SDATA[27]
H12
C7
SDATA[28]
G12
G9
SDATA[29]
F11
G8
SDATA[30]
G11
G6
SDATA[31]
L10
C6
IOZ
SDRAM Data Bus (Bits 0 through 31): The 32 pins of
the SDRAM data bus are inputs for read operations and
outputs for write operations. At all other times, these pins
are high-impedance.
Note: All SDRAM operations are controlled entirely by the
DS33Z11. No user programming for SDRAM buffering is
required.
SDA[0]
N9
J5
SDA[1]
N10
K5
SDA[2]
L11
H6
SDA[3]
K11
F9
SDA[4]
L7
C4
SDA[5]
L8
H4
O
SDRAM Address Bus 0 through 11: The 12 pins of the
SDRAM address bus output the row address first, followed
by the column address. The row address is determined by
SDA0 to SDA11 at the rising edge of clock. Column
address is determined by SDA0-SDA9 and SDA11 at the
rising edge of the clock. SDA10 is used as an auto-
precharge signal.
Note: All SDRAM operations are controlled entirely by the
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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