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參數(shù)資料
| 型號(hào)： | FUSION878A |
| 廠商： | CONEXANT SYSTEMS |
| 元件分類： | 顏色信號(hào)轉(zhuǎn)換 |
| 英文描述： | COLOR SIGNAL DECODER, PQFP128 |
| 封裝： | PLASTIC, QFP-128 |
| 文件頁(yè)數(shù)： | 144/180頁(yè) |
| 文件大?。?/td> | 2067K |
| 代理商： | FUSION878A |
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2.0 Functional Description
Fusion 878A
2.12 DMA Controller
PCI Video Decoder
2-42
Conexant
100600B
Each RISC instruction consists of 1 to 5 DWORDs. The 32-bits in the
DWORDs relay information such as the opcode, target address, status codes,
synchronization codes, byte count/enables, and start/end of line codes.
The SOL bit in the WRITE and SKIP instructions indicates that this particular
instruction is the first instruction of the scan line. The EOL bit in the WRITE and
SKIP instructions indicates that this particular instruction is the last instruction of
the scan line. An EOL flag from the FIFO and the last DWORD for the scan line
coincide with finishing the last instruction of the scan line. If the FIFO EOL
condition occurs early, the current instruction and all instructions leading up to
the one that contains the EOL flag will be aborted. If there is only one instruction
to process the line, both SOL and EOL bits will be set.
WRITE, WRITEC, and SKIP control the processing of active pixel data stored
in the FIFO. These three instructions alone control the sequence of packed mode
data written to target memory on a byte resolution basis. The WRITEC
instruction does not supply a target address. Instead, it relies on continuing from
the current DMA pointer contained in the target address counter. This value is
updated and kept current even during SKIP mode or FIFO overruns. However,
JUMP
0111
2
Jump the RISC program counter to the jump address. This allows unconditional
branching of the sequencer program.
DWORD0:
[15:0]
Reserved
[23:16]
Reset/Set RISC_STATUS
[24]
IRQ
[27:25]
Reserved
[31:28]
Opcode
DWORD1:
[31:0]
Jump address
DWORD-aligned
SYNC
1000
2
Synchronize all data in FIFO until the RISC instruction status bits equal the FIFO
status bits.
DWORD0:
[3:0]
Status
[14:4]
Reserved
[15]
RESYNC
A value of 1 disables FDSR errors
[23:16]
Reset/Set RISC_STATUS
[24]
IRQ
[27:25]
Reserved
[31:28]
Opcode
DWORD1:
[31:0]
Reserved
Table 2-10. RISC Instructions (5 of 5)
Instruction
Opcode
DWORDs
Description
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| FVXO-HC53BR-FREQ | VCXO, CLOCK, 0.75 MHz - 250 MHz, HCMOS OUTPUT |
| FVXO-HC72BR-FREQ | VCXO, CLOCK, 0.75 MHz - 180 MHz, HCMOS OUTPUT |
| FVXO-HC73B-FREQ | VCXO, CLOCK, 0.75 MHz - 250 MHz, HCMOS OUTPUT |
| FVXO-LC52BR-FREQ | VCXO, CLOCK, 0.75 MHz - 1000 MHz, LVDS OUTPUT |
| FVXO-LC72BR-FREQ | VCXO, CLOCK, 0.75 MHz - 1000 MHz, LVDS OUTPUT |
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參數(shù)描述 |
|---|---|
| FUSZ03 | 制造商:Honeywell Sensing and Control 功能描述: |
| FUTURE 1AA PLUS | 制造商:Ansmann 功能描述: 制造商:ANSMANN AG 功能描述: |
| FUTURE 2AA PLUS | 制造商:Ansmann 功能描述: 制造商:ANSMANN AG 功能描述: |
| FUTURE 2C PLUS | 制造商:Ansmann 功能描述: 制造商:ANSMANN AG 功能描述: |
| FUTURE 3D PLUS | 制造商:Ansmann 功能描述: 制造商:ANSMANN AG 功能描述: |
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