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參數(shù)資料
| 型號： | FUSION878A |
| 廠商： | CONEXANT SYSTEMS |
| 元件分類： | 顏色信號轉(zhuǎn)換 |
| 英文描述： | COLOR SIGNAL DECODER, PQFP128 |
| 封裝： | PLASTIC, QFP-128 |
| 文件頁數(shù)： | 157/180頁 |
| 文件大?。?/td> | 2067K |
| 代理商： | FUSION878A |
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2.0 Functional Description
Fusion 878A
2.18 Digital Audio Packetizer
PCI Video Decoder
2-54
Conexant
100600B
2.18 Digital Audio Packetizer
The Digital Audio Packetizer (DAP) block can packetize data input on ASCLK,
ALRCK, and ADATA in two additional modes besides normal I2S mode. It can
also packetize asynchronous parallel data from the GPIO pins (Asychronous Data
Parallel Port). This mode is described in the Electrical Interfaces Asychronous
Data Parallel mode section. Table 2-13 displays the DAP programming map.
2.18.1 Audio FIFO Memory and Status Codes
The audio FIFO is identical to the video 36 × 35 FIFO memory block. The 36 bits
allow for two 16-bit samples (or four 8-bit samples) and a 4-bit status nibble. The
planar mode FM3 code and the VRE code are not generated from the audio
packetizer. The SOL/EOL (1-4) codes bound the finite size audio packets
(number of bytes indicated by ALP_LEN). The size of the data byte buffers may
typically be set to the system memory page sizes. The FM1 and VRO codes
bound a finite number of packets. These delimiter codes are useful for providing
data delivery checks, RISC program loop checks, and synchronization. The PXV
code is used for all valid audio samples between the packetizing codes SOL/EOL.
Both the input and output sides of the FIFO run off the PCI clock.
2.18.2 PCI Bus Latency Tolerance for Audio Buffer
The latency-effective size of the audio FIFO is essentially 32 DWORDs or 64
samples of 16-bit audio. This allows for a maximum PCI bus latency of 286 s at
224 kHz (381 s at 149 kHz) sample rate before overflow will occur. This latency
drops to 143 s when in 8-bit mode, because the rate is 4X and the number of bits
is half. The digital audio input tolerates a maximum latency of 667 s at 48 kHz
16-bit L,R or 122 s at 1 MBps data before FIFO overflow.
Table 2-13. Digital Audio Packetizer Programming Map
Audio Control
Registers
I2S Mode
Asynchronous Data
Parallel Port
Data Packet Mode
High Speed Serial
Interface(1)
DA_APP
0
1
0
1
DA_IOM[0]
1
0
1
DA_DPM
0
1
See Section 2.16
NOTE(S):
(1) Set DA_SBR to 1 for High Speed Serial Interface Mode.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| FVXO-HC53BR-FREQ | VCXO, CLOCK, 0.75 MHz - 250 MHz, HCMOS OUTPUT |
| FVXO-HC72BR-FREQ | VCXO, CLOCK, 0.75 MHz - 180 MHz, HCMOS OUTPUT |
| FVXO-HC73B-FREQ | VCXO, CLOCK, 0.75 MHz - 250 MHz, HCMOS OUTPUT |
| FVXO-LC52BR-FREQ | VCXO, CLOCK, 0.75 MHz - 1000 MHz, LVDS OUTPUT |
| FVXO-LC72BR-FREQ | VCXO, CLOCK, 0.75 MHz - 1000 MHz, LVDS OUTPUT |
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參數(shù)描述 |
|---|---|
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| FUTURE 2AA PLUS | 制造商:Ansmann 功能描述: 制造商:ANSMANN AG 功能描述: |
| FUTURE 2C PLUS | 制造商:Ansmann 功能描述: 制造商:ANSMANN AG 功能描述: |
| FUTURE 3D PLUS | 制造商:Ansmann 功能描述: 制造商:ANSMANN AG 功能描述: |
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