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參數(shù)資料
| 型號： | MC68341FT16V |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16.78 MHz, MICROPROCESSOR, PQFP160 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 182/514頁 |
| 文件大?。?/td> | 2891K |
| 代理商： | MC68341FT16V |
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5- 106
MC68341 USER’S MANUAL
MOTOROLA
5.7.3.12 CONTROL INSTRUCTIONS. The control instruction table indicates the number
of clock periods needed for the processor to perform the specified operation on the given
addressing mode. Footnotes indicate when to account for the appropriate EA times. The
total number of clock cycles is outside the parentheses. The numbers inside parentheses
(r/p/w) are included in the total clock cycle number. All timing data assumes two-clock
reads and writes.
Instruction
Head
Tail
Cycles
ANDI
#, SR
0
2
12(0/2/0)
EORI
#, SR
0
2
12(0/2/0)
ORI
#, SR
0
2
12(0/2/0)
ANDI
#, CCR
2
0
6(0/2/0)
EORI
#, CCR
2
0
6(0/2/0)
ORI
#, CCR
2
0
6(0/2/0)
BSR.B
3
2
13(0/2/2)
BSR.W
3
2
13(0/2/2)
BSR.L
1
2
13(0/2/2)
CHK
FEA, Dn (no ex)
2
0
8(0/1/0)
CHK
FEA, Dn (ex)
2
42(2/2/6)
CHK2 (Save)
FEA, Dn (no ex)
1
3(0/1/0)
CHK2 (Op)
FEA, Dn (no ex)
2
0
18(X/0/0)
CHK2 (Save)
FEA, Dn (ex)
1
3(0/1/0)
CHK2 (Op)
FEA, Dn (ex)
2
52(X
+ 2/1/6)
JMP
CEA
0
2
6(0/2/0)
JSR
CEA
3
2
13(0/2/2)
LEA
CEA, An
0
2(0/1/0)
LINK.W
An, #
2
0
10(0/2/2)
LINK.L
An, #
0
10(0/3/2)
NOP
0
2(0/1/0)
PEA
CEA
0
8(0/1/2)
RTD
#
1
2
12(2/2/0)
RTR
1
2
14(3/2/0)
RTS
1
2
12(2/2/0)
UNLK
An
1
0
9(2/1/0)
X = There is one bus cycle for byte and word operands and two bus cycles for long-word
operands. For long-word bus cycles, add two clocks to the tail and to the number of
cycles.
NOTE: The CHK2 instruction involves a save step that other instructions do not have. To
calculate the total instruction time, calculate the save, the EA, and the operation
execution times, and combine in the order listed using the equations given in 5.7.1.6
Instruction Execution Time Calculation.
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
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c
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