參數(shù)資料
型號： TMX320TCI6482ZTZ
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號處理
英文描述： Communications Infrastructure Digital Signal Processor
中文描述： 通信基礎(chǔ)設(shè)施的數(shù)字信號處理器
文件頁數(shù)： 236/255頁
文件大小： 1893K
代理商： TMX320TCI6482ZTZ
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www.ti.com
TMS320TCI6482
Communications Infrastructure Digital Signal Processor
SPRS246F–APRIL 2005–REVISED MAY 2007
Table 8-112. RapidIO Control Registers (continued)
HEX ADDRESS RANGE
02D0 060C
02D0 0610
02D0 0614
02D0 0618
02D0 061C
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02D0 0748 - 02D0 07DC
02D0 07E0
02D0 07E4
02D0 07E8
ACRONYM
REGISTER NAME
RIO_QUEUE3_RXDMA_HDP
RIO_QUEUE4_RXDMA_HDP
RIO_QUEUE5_RXDMA_HDP
RIO_QUEUE6_RXDMA_HDP
RIO_QUEUE7_RXDMA_HDP
RIO_QUEUE8_RXDMA_HDP
RIO_QUEUE9_RXDMA_HDP
RIO_QUEUE10_RXDMA_HDP
RIO_QUEUE11_RXDMA_HDP
RIO_QUEUE12_RXDMA_HDP
RIO_QUEUE13_RXDMA_HDP
RIO_QUEUE14_RXDMA_HDP
RIO_QUEUE15_RXDMA_HDP
-
RIO_QUEUE0_RXDMA_CP
RIO_QUEUE1_RXDMA_CP
RIO_QUEUE2_RXDMA_CP
RIO_QUEUE3_RXDMA_CP
RIO_QUEUE4_RXDMA_CP
RIO_QUEUE5_RXDMA_CP
RIO_QUEUE6_RXDMA_CP
RIO_QUEUE7_RXDMA_CP
RIO_QUEUE8_RXDMA_CP
RIO_QUEUE9_RXDMA_CP
RIO_QUEUE10_RXDMA_CP
RIO_QUEUE11_RXDMA_CP
RIO_QUEUE12_RXDMA_CP
RIO_QUEUE13_RXDMA_CP
RIO_QUEUE14_RXDMA_CP
RIO_QUEUE15_RXDMA_CP
-
RIO_TX_QUEUE_TEAR_DOWN
RIO_TX_CPPI_FLOW_MASKS0
RIO_TX_CPPI_FLOW_MASKS1
RIO_TX_CPPI_FLOW_MASKS2
RIO_TX_CPPI_FLOW_MASKS3
RIO_TX_CPPI_FLOW_MASKS4
RIO_TX_CPPI_FLOW_MASKS5
RIO_TX_CPPI_FLOW_MASKS6
RIO_TX_CPPI_FLOW_MASKS7
-
RIO_RX_QUEUE_TEAR_DOWN
RIO_RX_CPPI_CNTL
-
RIO_TX_QUEUE_CNTL0
RIO_TX_QUEUE_CNTL1
RIO_TX_QUEUE_CNTL2
Queue Receive DMA Head Descriptor Pointer Register 3
Queue Receive DMA Head Descriptor Pointer Register 4
Queue Receive DMA Head Descriptor Pointer Register 5
Queue Receive DMA Head Descriptor Pointer Register 6
Queue Receive DMA Head Descriptor Pointer Register 7
Queue Receive DMA Head Descriptor Pointer Register 8
Queue Receive DMA Head Descriptor Pointer Register 9
Queue Receive DMA Head Descriptor Pointer Register 10
Queue Receive DMA Head Descriptor Pointer Register 11
Queue Receive DMA Head Descriptor Pointer Register 12
Queue Receive DMA Head Descriptor Pointer Register 13
Queue Receive DMA Head Descriptor Pointer Register 14
Queue Receive DMA Head Descriptor Pointer Register 15
Reserved
Queue Receive DMA Completion Pointer Register 0
Queue Receive DMA Completion Pointer Register 1
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Queue Receive DMA Completion Pointer Register 8
Queue Receive DMA Completion Pointer Register 9
Queue Receive DMA Completion Pointer Register 10
Queue Receive DMA Completion Pointer Register 11
Queue Receive DMA Completion Pointer Register 12
Queue Receive DMA Completion Pointer Register 13
Queue Receive DMA Completion Pointer Register 14
Queue Receive DMA Completion Pointer Register 15
Reserved
Transmit Queue Teardown Register
Transmit CPPI Supported Flow Mask Register 0
Transmit CPPI Supported Flow Mask Register 1
Transmit CPPI Supported Flow Mask Register 2
Transmit CPPI Supported Flow Mask Register 3
Transmit CPPI Supported Flow Mask Register 4
Transmit CPPI Supported Flow Mask Register 5
Transmit CPPI Supported Flow Mask Register 6
Transmit CPPI Supported Flow Mask Register 7
Reserved
Receive Queue Teardown Register
Receive CPPI Control Register
Reserved
Transmit CPPI Weighted Round Robin Control Register 0
Transmit CPPI Weighted Round Robin Control Register 1
Transmit CPPI Weighted Round Robin Control Register 2
C64x+ Peripheral Information and Electrical Specifications
236
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