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參數(shù)資料
| 型號(hào)： | 935263331557 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP240 |
| 封裝： | 32 X 32 MM, 3.40 MM HEIGHT, MSQFP-240 |
| 文件頁數(shù)： | 239/518頁 |
| 文件大?。?/td> | 7111K |
| 代理商： | 935263331557 |
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Philips Semiconductors
DSPCPU Operations for TM1100
File: ops.fm5, modified 7/23/99
PRELIMINARY INFORMATION
A-39
Floating-point add
SYNTAX
[ IF r
guard ] fadd rsrc1 rsrc2
→ rdest
FUNCTION
if r
guard then
r
dest
← (oat)rsrc1 + (oat)rsrc2
ATTRIBUTES
Function unit
falu
Operation code
22
Number of operands
2
Modier
No
Modier range
—
Latency
3
Issue slots
1, 4
DESCRIPTION
The fadd operation computes the sum r
src1+rsrc2 and stores the result into rdest. All values are in IEEE single-
precision oating-point format. Rounding is according to the IEEE rounding mode bits in PCSW. If an argument is
denormalized, zero is substituted for the argument before computing the sum, and the IFZ ag in the PCSW is set. If
the result is denormalized, the result is set to zero instead, and the OFZ ag in the PCSW is set. If fadd causes an
IEEE exception, the corresponding exception ags in the PCSW are set. The PCSW exception ags are sticky: the
ags can be set as a side-effect of any oating-point operation but can only be reset by an explicit writepcsw
operation. The update of the PCSW exception ags occurs at the same time as r
dest is written. If any other oating-
point compute operations update the PCSW at the same time, the net result in each exception ag is the logical OR of
all simultaneous updates ORed with the existing PCSW value for that exception ag.
The faddflags operation computes the exception ags that would result from an individual fadd.
The fadd operation optionally takes a guard, specied in r
guard. If a guard is present, its LSB controls the
modication of the destination register. If the LSB of r
guard is 1, rdest and the exception ags in PCSW are written;
otherwise, r
dest is not changed and the operation does not affect the exception ags in PCSW.
EXAMPLES
Initial Values
Operation
Result
r60 = 0xc0400000 (–3.0),
r30 = 0x3f800000 (1.0)
fadd r60 r30
→ r90
r90
← 0xc0000000 (–2.0)
r40 = 0x40400000 (3.0),
r60 = 0xc0400000 (–3.0)
fadd r40 r60
→ r95
r95
← 0x00000000 (0.0)
r10 = 0, r40 = 0x40400000 (3.0),
r80 = 0x00800000 (1.17549435e-38)
IF r10 fadd r40 r80
→ r100
no change, since guard is false
r20 = 1, r40 = 0x40400000 (3.0),
r80 = 0x00800000 (1.17549435e-38)
IF r20 fadd r40 r80
→ r110
r110
← 0x40400000 (3.0), INX ag set
r40 = 0x40400000 (3.0),
r81 = 0x00400000 (5.877471754e–39)
fadd r40 r81
→ r111
r111
← 0x40400000 (3.0), IFZ ag set
r82 = 0x00c00000 (1.763241526e-38),
r83 = 0x80800000 (–1.175494351e-38)
fadd r82 r83
→ r112
r112
← 0x00000000 (0.0), OFZ, UNF,
INX ags set
r84 = 0x7f800000 (+INF),
r85 = 0xff800000 (–INF)
fadd r84 r85
→ r113
r113
← 0xffffffff (QNaN), INV ag set
r70 = 0x7f7fffff (3.402823466e+38)
fadd r70 r70
→ r120
r120
← 0x7f800000 (+INF), OVF,
INX ags set
r80 = 0x00800000 (1.763241526e–38)
fadd r80 r80
→ r125
r125
← 0x01000000 (2.350988702e–38)
SEE ALSO
fadd
相關(guān)PDF資料 |
PDF描述 |
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| 933282660652 | TRIPLE 2-CHANNEL, SGL ENDED MULTIPLEXER, PDIP16 |
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參數(shù)描述 |
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