參數(shù)資料
型號(hào)： CS8952-IQZ
廠商： Cirrus Logic Inc
文件頁(yè)數(shù)： 5/81頁(yè)
文件大小： 0K
描述： IC TXRX 100/10 PHY 100TQFP
標(biāo)準(zhǔn)包裝： 90
類型： 收發(fā)器
規(guī)程： MII
電源電壓： 4.75 V ~ 5.25 V
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
供應(yīng)商設(shè)備封裝： 100-TQFP（14x14）
包裝： 托盤
產(chǎn)品目錄頁(yè)面： 759 (CN2011-ZH PDF)
其它名稱： 598-1208
CS8952
CrystalLAN 100BASE-X and 10BASE-T Transceiver
13
DS206F1
10BASE-T MII TRANSMIT TIMING
Parameter
Symbol
Min
Typ
Max
Unit
TXD[3:0] Setup to TX_CLK High
tSU1
10
-
ns
TX_ER Setup to TX_CLK High
tSU2
10
-
ns
TX_EN Setup to TX_CLK High
tSU3
10
-
ns
TXD[3:0] Hold after TX_CLK High
tHD1
0-
-
ns
TX_ER Hold after TX_CLK High
tHD2
0-
-
ns
TX_EN Hold after TX_CLK High
tHD3
0-
-
ns
TX_EN “high” to CRS asserted latency
tCRS1
0-
4
BT
TX_EN “l(fā)ow” to CRS de-asserted latency
tCRS2
0-
16
BT
TX_EN “high” to TX+/- output (TX Latency)
tLAT
6-
14
BT
SQE Timing
COL (SQE) Delay after CRS de-asserted
tCOL
0.65
0.9
1.6
s
COL (SQE) Pulse Duration
tCOLP
0.65
1.0
1.6
s
TX_CLK
TX_EN
TX_ER
TXD[3:0]
CRS
TX+/-
tSU3
tSU2
tSU1
tHD3
tHD2
tHD1
tCRS1
tCRS2
tLAT
Valid
Data
Input/Output
Input
Output
TX_CLK
tSQE
COL
tSQEP
Input/Output
Output
SQE Timing
10BASE-T Transmit Timing
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PDF描述
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