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參數(shù)資料
| 型號： | EWIXP455ABT |
| 廠商： | INTEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 266 MHz, RISC PROCESSOR, PBGA544 |
| 封裝： | LEAD FREE, PLASTIC, BGA-544 |
| 文件頁數(shù)： | 49/163頁 |
| 文件大?。?/td> | 1123K |
| 代理商： | EWIXP455ABT |
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Electrical Specifications
May 2005
Intel IXP45X and Intel IXP46X Product Line of Network Processors Datasheet
142
Document Number: 306261-002
Trdsetup
Data valid required before the rising edge of RD_N
5.3
14.7
ns
Trdhold
Data hold required after the rising edge of RD_N
2
ns
Trecov
Time needed between successive accesses on expansion
interface.
116
Cycles 6
Figure 34.
Intel Simplex Mode
Table 66.
Intel Multiplexed Mode Values (Sheet 2 of 2)
Symbol
Parameter
Min.
Max.
Units
Notes
NOTES:
1. The EX_ALE signal is extended form T to 4T nnsec based on the programming of the T1 timing parameter.
The parameter Tale2addrhold is fixed at T.
2. Setting the address phase parameter (T1) will adjust the duration that the address appears to the external device.
3. Setting the data setup phase parameter (T2) will adjust the duration that the data appears prior to a data
strobe (read or write) to an external device.
4. Setting the data strobe phase parameter (T3) will adjust the duration that the data strobe appears (read or
write) to an external device. Data will be available during this time as well.
5. Setting the data hold strobe phase parameter (T4) will adjust the duration that the chip selects, address, and
data (during a write) will be held.
6. Setting the recovery phase parameter (T5) will adjust the duration between successive accesses on the
expansion interface.
7. T is the period of the clock measured in ns.
8. Clock to output delay for all signals will be a maximum of 15 ns for devices requiring operation in
synchronous mode.
9. Timing was designed for a system load between 5pF and 60pF for high drive setting
A9586-01
EX_CLK
EX_ADDR
EX_DATA
EX_RD_N
EX_DATA
EX_WR_N
Valid Address
Output Data
T5
1-16 Cycles
T4
1-4 Cycles
EX_CS_N
Twrpulse
Trecov
Taddr2valcs
Tdval2valwrt
Input Data
Tdhold2afterwr
T3
1-16 Cycles
T2
1-4 Cycles
T1
1-4 Cycles
Trdsetup
Trdhold
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