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參數(shù)資料
| 型號： | IDT88K8483BRI |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 25/162頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SPI-4 EXCHANGE 3PORT 672-BGA |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 系列： | * |
| 其它名稱： | 88K8483BRI |
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120 of 162
October 20, 2006
IDT IDT88K8483
SPI-4 Egress Status Clock Timing Register
Packet Fragment Processor (PFP) Registers
PFP Buffer Segment Assign Table
There are 64 registers in this table, one for each LID.
Field
Read /
Write
Bits
Length Reset
State
Description
SCTC[0:3]
R/W
0:0-0:3
4
0
This register is used to manually align the phase of the SPI-4 egress status clock
to the status outputs by adding from 0.1 clock cycle to 0.9 clock cycles of delay
to the status clock output. Note that the clock delay value is not monotonically
related to the value encoded in the bit field [3:0].
The SCTC[3:0] field is valid only for LVDS status, not for LVTTL
status.
SCTC [3:0] Used for adding 0.1 unit intervals of output delay to the SPI-
4 egress status clock output.
[3:0]=0=No added delay
[3:0]=1=Add 0.1 clock cycle of delay t o the SPI-4 egress status clock
[3:0]=3=Add 0.2 clock cycles of delay to the SPI-4 egress status clock
[3:0]=2=Add 0.3 clock cycles of delay to the SPI-4 egress status clock
[3:0]=7=Add 0.4 clock cycles of delay to the SPI-4 egress status clock
[3:0]=6=Add 0.5 clock cycles of delay to the SPI-4 egress status clock
[3:0]=4=Add 0.6 clock cycles of delay to the SPI-4 egress status clock
[3:0]=5=Add 0.7 clock cycles of delay to the SPI-4 egress status clock
[3:0]=F=Add 0.8 clock cycles of delay to the SPI-4 egress status clock
[3:0]=E=Add 0.9 clock cycles of delay to the SPI-4 egress status clock
Table 93
SPI-4 Egress Status Clock Timing Control (Block Base=0x0900, Register Offset=0x2E)
Field
Read /
Write
Bits
Length Reset
State
Description
M
R/W
0:0-1:0
9
0
Maximum number of data buffer segments per LID of the available 508 segments in
the PFP.
Reserved
R
1:1-1:7
7
THR_STARV
R/W
2:0-2:7
8
0
Indicates the starving threshold. Status is set to starving if the number of free seg-
ments in the data buffer is more than or equal to the starving threshold
THR_HUNG
R/W
3:0-3:7
8
0
Indicates the hungry threshold. Status is set to hungry if the number of free seg-
ments in the data buffer is less than or equal to the starving thresholds but greater
than or equal to the hungry threshold.
Status is set to satisfied if the number of free segments in the data buffer is greater
than the hungry threshold.
Table 94 PFP Buffer Segment Assign Table (Block Base=0x01000/0x1800, Register Offset=0x00-0x3F)
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| IDT88P8344 | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:SPI EXCHANGE 4 x SPI-3 TO SPI-4 Issue 1.0 |
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