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參數(shù)資料
| 型號： | P32P4910A |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 光電元器件 |
| 英文描述： | PRML Read Channel with PR4, 8/9 ENDEC, 4-Burst Servo |
| 中文描述： | READ CHANNEL, PQFP100 |
| 文件頁數(shù)： | 98/196頁 |
| 文件大小： | 1056K |
| 代理商： | P32P4910A |
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L
G
R
Input/Output Ports
General Release Specification
MC68HC(7)05H12
—
Rev. 1.0
96
Input/Output Ports
MOTOROLA
At power-on or reset, all DDRs are cleared, which configure all port pins
as inputs. The data direction registers are capable of being written to or
read by the processor. During the programmed output state, a read of
the data register actually reads the value of the output data latch and not
the I/O pin.
R/W is an internal signal.
Figure 7-17. Port I/O Circuitry
NOTE:
If the I/O pin is an input and a read-modify (RMW) instruction is
executed, the I/O pin will be read into the HC05 CPU and the computed
result will then be written to the data latch.
Table 7-1. I/O Pin Functions
R/W
DDR
I/O Pin Function
0
0
The I/O pin is in input mode. Data is written into the output data latch.
0
1
Data is written into the output data latch and output to the I/O pin.
1
0
The state of the I/O pin is read.
1
1
The I/O pin is in output mode. The output data latch is read.
Data Direction
Register Bit
Latched Output
Data Bit
I/O
Pin
Input
Reg
Bit
Input
I/O
Output
Internal
HC05
Connections
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| P32P4911A | PRML Read Channel with PR4, 8/9 ENDEC, FWR Servo |
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參數(shù)描述 |
|---|---|
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