參數(shù)資料
型號(hào)： PEF22554E
廠商： INFINEON TECHNOLOGIES AG
元件分類： 數(shù)字傳輸電路
英文描述： DATACOM, FRAMER, PBGA160
封裝： GREEN, PLASTIC, QFP-144
文件頁(yè)數(shù)： 345/700頁(yè)
文件大小： 25742K
代理商： PEF22554E
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Data Sheet
409
Rev. 1.2, 2006-01-26
QuadFALCTM
PEF 22554 E
E1 Registers
RFS3
4
rsc
Receive Frame Start - HDLC Channel 3
This is an early receiver interrupt activated after the start of a valid frame
has been detected, i.e. after an address match (in operation modes
providing address recognition), or after the opening flag (transparent
mode 0) is detected, delayed by two bytes. After an RFS2 interrupt, the
contents of
RAL1
RSIS3 bits 3 to 1
Are valid and can be read by the external micro controller.
0B
no frame start has been detected on HDLC channel 3.
1B
a frame start has been detected on HDLC channel 3, RAL1 and
RSIS3(3:1) are valid.
RDO3
3
rsc
Receive Data Overflow - HDLC Channel 3
This interrupt status indicates that the external micro controller did not
respond fast enough to an RPF3 or RME3 interrupt and that data in
RFIFO3 has been lost. Even when this interrupt status is generated, the
frame continues to be received when space in the RFIFO3 is available
again.
Note: Whereas the bit RSIS3.RDO3 in the frame status byte indicates
whether an overflow occurred when receiving the frame currently
accessed in the RFIFO3, the ISR5.RDO3 interrupt status is
generated as soon as an overflow occurs and does not necessarily
pertain to the frame currently accessed by the processor.
0B
no receive data overflow has been detected on HDLC channel 3.
1B
a receive data overflow has been detected on HDLC channel 3.
ALLS3
2
rsc
All Sent - HDLC Channel 3
This bit is set if the last bit of the current frame has been sent completely
and XFIFO3 is empty. This bit is valid in HDLC mode only.
0B
data transmission is in progress on HDLC channel 3.
1B
data transmission is idle on HDLC channel 3, XFIFO3 is empty.
XDU3
1
rsc
Transmit Data Underrun - HDLC Channel 3
Transmitted frame was terminated with an abort sequence because no
data was available for transmission in XFIFO3 and no XME3 was issued.
Note: Transmitter and XFIFO3 are reset and deactivated if this condition
occurs. They are reactivated not before this interrupt status register
has been read. Thus, XDU3 should not be masked via register
IMR5. Additionally, CMDR4.SRES3 must be set after XDU occurs
to reset the signaling transmitter.
0B
data transmission is in progress on HDLC channel 3.
1B
data transmission has been stopped due to data underrun on
HDLC channel 3.
RPF3
0
rsc
Receive Pool Full - HDLC Channel 3
32 bytes of a frame have arrived in the receive FIFO3. The frame is not
yet completely received.
0B
data reception is in progress on HDLC channel 3.
1B
data has been stored in RFIFO3 and can be read.
Field
Bits
Type
Description
相關(guān)PDF資料
PDF描述
PEF22554HT DATACOM, FRAMER, PQFP144
PES12-42S-N0024
PESD3V3V4UK,132 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE
PF38F3050L0YUQ3A SPECIALTY MEMORY CIRCUIT, PBGA88
PFC04108.2UHKT 1 ELEMENT, 8.2 uH, GENERAL PURPOSE INDUCTOR
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
PEF22554E-V2.1 制造商:Infineon Technologies AG 功能描述:DATACOM, FRAMER, PBGA160
PEF22554EV2.1-G 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
PEF22554EV21 制造商:Rochester Electronics LLC 功能描述:- Bulk
PEF22554EV3.1 制造商:Rochester Electronics LLC 功能描述:- Bulk
PEF22554EV3.1-G 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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