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參數(shù)資料
| 型號(hào)： | PSB7230 |
| 廠(chǎng)商： | SIEMENS A G |
| 元件分類(lèi)： | 編解碼器 |
| 英文描述： | Joint Audio Decoder-Encoder for Analog Videophone JADE AN |
| 中文描述： | A/MU-LAW, PCM CODEC, PQFP100 |
| 文件頁(yè)數(shù)： | 123/179頁(yè) |
| 文件大?。?/td> | 2422K |
| 代理商： | PSB7230 |
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PSB 7230
Firmware Features
Semiconductor Group
123
Data Sheet 1998-07-01
The structure of the control and status data blocks is identical. The host writes the control
block to change the settings of the JADE AN and reads the status block to evaluate the
current settings of the JADE AN.
The control/status block is organized in 8-bit words and has the following structure:
Note: Unless otherwise indicated, the host has to switch the MODE to neutral for at least
3 frames (default: 30 ms) before it can change the control block. Only the
underlined bits may also be changed on the fly disregarding that rule. After Reset,
the JADE AN is automatically in the neutral mode, so changes to the control block
can be done immediately after the JADE has finished its initialization phase (see
Section 6.2.3
).
(MSB)
PSEL
0
HP723
0
EM3
I
0
EV7
DV7
(LSB)
1
0
0
0
DM0
L0
d
EV0
DV0
CTRL
UDF
G723C
ISEL1
0
PF723
0
EM2
0
0
EV6
DV6
ISEL0
0
0
0
EM1
0
Re1
EV5
DV5
FLEN
UDF1
0
0
EM0
P1
Re0
EV4
DV4
0
0
0
0
0
0
1
0
0
UDF0
0
0
DM3
P0
Rd1
EV3
DV3
MODE
OPT1
OPT2
EVOL
DVOL
DM2
L2
Rd0
EV2
DV2
DM1
L1
e
EV1
DV1
相關(guān)PDF資料 |
PDF描述 |
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