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參數(shù)資料
| 型號： | PSB7230 |
| 廠商： | SIEMENS A G |
| 元件分類： | 編解碼器 |
| 英文描述： | Joint Audio Decoder-Encoder for Analog Videophone JADE AN |
| 中文描述： | A/MU-LAW, PCM CODEC, PQFP100 |
| 文件頁數(shù)： | 31/179頁 |
| 文件大?。?/td> | 2422K |
| 代理商： | PSB7230 |
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PSB 7230
Interfaces and Memory Organization
Semiconductor Group
31
Data Sheet 1998-07-01
SCLK is derived from the chip-internal DSP clock via a programmable baud rate
generator (division factor 1, 2, 3
… 1024).
The Receive Frame Sync (RFS), when programmed as output, has two selectable
modes of operation:
– In the
continuous mode
(CONT = 1), pulses are continuously generated, separated
by a distance
16
×
(PRD + 1) bits from each other, where PRD = 0 … 255.
– In the
burst mode
(CONT = 0), pulses are generated upon command a
programmable number of times (REP + 1 : 1 … 1024), spaced 16 bits apart from each
other.
The same applies to TFS when it is an output.
SCLK
Input or output
Bits on SR/ST are clocked out with the rising edge of SCLK and latched in with
the falling edge of SCLK. When SCLK is programmed as output, it is derived
from a programmable baud rate generator.
Input or output
Marks the beginning of the physical frame on SR.
When input:
Sampled with a falling edge of SCLK
When output:
Clocked out with the rising or falling edge of SCLK
(duration = 1 SCLK period).
Repetition rate (continuous mode) or number of
pulses (burst mode) is programmable
Input or output
Marks the beginning of the physical frame on ST.
When input:
Sampled with a falling edge of SCLK
When output:
Clocked out with the rising or falling edge of SCLK
(duration = 1 SCLK period).
Repetition rate (continuous mode) or number of
pulses (burst mode) is programmable
RFS
TFS
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PDF描述 |
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