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參數(shù)資料
| 型號： | PSB7230 |
| 廠商： | SIEMENS A G |
| 元件分類： | 編解碼器 |
| 英文描述： | Joint Audio Decoder-Encoder for Analog Videophone JADE AN |
| 中文描述： | A/MU-LAW, PCM CODEC, PQFP100 |
| 文件頁數(shù)： | 62/179頁 |
| 文件大?。?/td> | 2422K |
| 代理商： | PSB7230 |
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PSB 7230
Functional Blocks
Semiconductor Group
62
Data Sheet 1998-07-01
Note on Latency of Serial Data
When the data receiver is enabled (via bit RAC), the data receiver is clocked with the
serial interface clock even outside the selected time-slot. However, the logic at the input
of the data receiver is only clocked with the serial clock during the selected time-slot.
Consequently, N bits are loaded into HRR register from the serial line after N clock edges
inside the selected time-slot (N is equal to 8, 16 or 32 depending on LMOD). Similarly,
data from HRW register is loaded into data receiver only after a certain number of clock
edges inside the selected time-slot have occurred. The latency (delay) of received data
from the input pin to the data FIFO is given in the following as a function of LMOD (C
TS
means the number of clock edges inside the active time-slot, C means the number of
clock edges independent of the active time-slot):
Similarly, latencies apply in the case of the data from the output of the data transmitter
FIFOs to the serial output pin. Those are different for the first 1, 2 or 4 bytes (“start”) and
the following bytes (“stationary”):
t
: Delay between BFHX1 interrupt status and write to HXW1 register by DSP or host
(programmable via HHX1).
Table 13
Receiver Delays
Start & Stationary
8 C
TS
+ 9 C
16 C
TS
+ 9 C
32 C
TS
+ 17 C
64 C
TS
+ 33 C
LMOD = 00
LMOD = 01
LMOD = 10
LMOD = 11
Table 14
Transmitter Delays
Start
10 C
11 C +
t
19 C +
t
35 C +
t
Stationary
10 C + 8 C
TS
10 C + 16 C
TS
18 C + 32 C
TS
34 C + 64 C
TS
LMOD = 00
LMOD = 01
LMOD = 10
LMOD = 11
相關PDF資料 |
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