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參數(shù)資料
| 型號： | PSB7230 |
| 廠商： | SIEMENS A G |
| 元件分類： | 編解碼器 |
| 英文描述： | Joint Audio Decoder-Encoder for Analog Videophone JADE AN |
| 中文描述： | A/MU-LAW, PCM CODEC, PQFP100 |
| 文件頁數(shù)： | 71/179頁 |
| 文件大小： | 2422K |
| 代理商： | PSB7230 |
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PSB 7230
Functional Blocks
Semiconductor Group
71
Data Sheet 1998-07-01
Each data byte is transmitted at least twice (only twice if the receiver is fast enough so
that the transmitter works at maximum speed), namely once when MX is 1, and once
when MX is 0 in the next frame. The only exception is the first byte, which is transmitted
in three consecutive frames (where MX = 1, 0, 0, respectively).
In order for the transmitter to recognize that the receiver has correctly acknowledged the
last byte, the interrupt status MEA is set after the received MR bit is received at 1 in two
consecutive frames (interrupt status different from MAB). The condition for generating
an MEA interrupt status is the
recognition of a MR = 0, 1, 1 sequence when MXC = 0
.
Figure 31
Figure 31
shows the general case,
Figure 32
the maximum speed case.
Software Handling of Monitor Channel Reception
The receiver of the Monitor channel is controlled via the MRE bit. As long as the MRE bit
is zero, no evaluation of the received MX bit is done. If the MRE bit is set to 1, then the
Monitor channel hardware waits for a start of a Monitor packet. When the start of a
packet is recognized with a Monitor byte matching monitor receive address,
acknowledgement can be enabled by the software by setting the MR Control bit MRC
相關(guān)PDF資料 |
PDF描述 |
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