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參數資料
| 型號： | T8301 |
| 英文描述： | T8301 Internet Protocol Telephone Phone-On-A-Chip⑩ IP Solution DSP |
| 中文描述： | T8301因特網協(xié)議電話熱線電話在一個芯片⑩DSP的IP解決方案 |
| 文件頁數： | 93/190頁 |
| 文件大?。?/td> | 1535K |
| 代理商： | T8301 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁當前第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁
Data Sheet
March 2000
DSP1627 Digital Signal Processor
Lucent Technologies Inc.
57
5 Software Architecture
(continued)
Field Descriptions
Table 41. T Field
Specifies the type of instruction.
Table 42. D Field
Specifies a destination accumulator.
Table 43.
aT
Field
Specifies transfer accumulator.
Table 44. S Field
Specifies a source accumulator.
Table 45. F1 Field
Specifies the multiply/ALU function.
Table 46. X Field
Specifies the addressing of ROM data in two-operand
multiply/ALU instructions. Specifies the high or low half
of an accumulator or the
y
register in one-operand mul-
tiply/ALU instructions.
T
Operation
goto JA
Short imm j, k, rb, re
Short imm r0, r1, r2, r3
Y = a1[l]
Z : aT[l]
Y
aT[l] = Y
Bit 0 = 0, aT = R
Bit 0 = 1, aTl = R
Bit 10 = 0, R = a0
Bit 10 = 1, R = a0l
R = IM16
Bit 10 = 0, R = a1
Bit 10 = 1, R = a1l
Y = R
Z : R
do, redo
R = Y
call JA
ifc CON
if CON
Y = y[l]
Z : y[l]
x = Y
y[l] = Y
Bit 0 = 0, branch indirect
Bit 0 = 1, F3 ALU
y = a0 x = X
Cond. branch qualifier
y = a1 x = X
Y = a0[l]
Z : y x = X
Bit 5 = 0, F4 ALU (BMU)
Bit 5 = 1, direct addressing
y = Y x = X
Format
4
9
9
1
2a
1
1a
7
7
7
7
8
7
7
7
7
10
7
4
3
3
1
2
1
1
5
3a
1
6
1
1
2
3b
9a
1
0000x
00010
00011
00100
00101
00110
00111
01000
01000
01001
01001
01010
01011
01011
01100
01101
01110
01111
1000x
10010
10011
10100
10101
10110
10111
11000
11000
11001
11010
11011
11100
11101
11110
11110
11111
F1
F1
F1
F1
F2
F2
F1
F1
F1
F1
F1
F1
F1
F1
F1
D
0
1
Register
Accumulator 0
Accumulator 1
aT
0
1
Register
Accumulator 1
Accumulator 0
S
0
1
Register
Accumulator 0
Accumulator 1
F1
0000
0001
0010
0011
0100
0101
0110
0111
1000
1001
1010
1011
1100
1101
1110
1111
Operation
aD = pp = x * y
aD = aS + pp = x * y
p = x *
y
aD = aS – pp = x * y
aD = p
aD = aS + p
nop
aD = aS – p
aD = aS | y
aD = aS ^ y
aS & y
aS – y
aD = y
aD = aS + y
aD = aS & y
aD = aS – y
X
Operation
Two-Operand Multiply/ALU
0
*
pt++
*
pt++i
1
One-Operand Multiply/ALU
0
1
aTl, yl
aTh, yh
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