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參數(shù)資料
| 型號： | AD9548BCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 38/112頁 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN/SYNCHRONIZR 88LFCSP |
| 產(chǎn)品變化通告： | AD9548 Mask Change 20/Oct/2010 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | 時鐘/頻率發(fā)生器，同步器 |
| PLL： | 是 |
| 主要目的： | 以太網(wǎng)，SONET/SDH，Stratum |
| 輸入： | CMOS，LVDS，LVPECL |
| 輸出： | CMOS，LVDS，LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:1 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 750kHz |
| 電源電壓： | 1.71 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 88-VFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 88-LFCSP-VQ（12x12） |
| 包裝： | 托盤 |
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Data Sheet
AD9548
Rev. E | Page 31 of 112
The promoted priority parameter allows the user to assign a
higher priority to a reference after it becomes the active
reference. For example, suppose four references have a selection
priority of 3 and a promoted priority of 1, and the remaining
references have a selection priority or 2 and a promoted priority
of 2. Now, assume that one of the Priority 3 references becomes
active because all of the Priority 2 references have failed. Some-
time later, however, a Priority 2 reference becomes valid. The
switchover logic normally attempts to automatically switch over
to the Priority 2 reference because it has higher priority than the
presently active Priority 3 reference. However, because the
Priority 3 reference is active, its promoted priority of 1 is in
effect. This is a higher priority than the newly validated
reference’s priority of 2, so the switchover does not occur. This
mechanism enables the user to give references preferential
treatment while they are selected as the active reference. An
example of promoted vs. nonpromoted priority switching
appears in state diagram form in Figure 36. Figure 37 shows a
block diagram of the interrelationship between the reference
inputs, monitors, validation logic, profile selection, and priority
selection functionality.
A
ACTIVE
B
ACTIVE
C
ACTIVE
A FAULTED
B FAULTED
ALL VALID
INITIAL
STATE
A VALID
B VALID
A VALID
B VALID
INPUT
PRIORITY
PROMOTED
A0
0
B1
0
C2
1
D3
2
PRIORITY TABLE
COMMON
WITHOUT PROMOTION
WITH PROMOTION
080
22
-01
1
Figure 36. Example of Priority Promotion
PROFILE
SELECTION
VALIDATION
LOGIC
PRIORITY
SELECTION
÷R
MONITORS
A/AA
B/BB
C/CC
D/DD
TDC
LOOP
CONTROLLER
……
…
……
…
08
02
2-
01
2
Figure 37. Reference Clock Block Diagram
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| V375C36M150BL3 | CONVERTER MOD DC/DC 36V 150W |
| MAX3676EHJ+ | IC CLOCK RECOVERY 32-TQFP |
| ADN2813ACPZ | IC CLK/DATA REC 1.25GBPS 48LFCSP |
| AD800-52BRZ | IC CLK\DATA RECOVERY PLL 20SOIC |
| SY87700VZH | IC CLK/DATA RECOVERY 3.3V 28SOIC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AD9548BCPZ-REEL7 | 功能描述:IC CLOCK GEN/SYNCHRONIZR 88LFCSP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 專用 系列:- 標(biāo)準(zhǔn)包裝:28 系列:- 類型:時鐘/頻率發(fā)生器 PLL:是 主要目的:Intel CPU 服務(wù)器 輸入:時鐘 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:3:22 差分 - 輸入:輸出:無/是 頻率 - 最大:400MHz 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:64-TFSOP （0.240"，6.10mm 寬） 供應(yīng)商設(shè)備封裝:64-TSSOP 包裝:管件 |
| AD9548XCPZ | 制造商:Analog Devices 功能描述: |
| AD9549 | 制造商:AD 制造商全稱:Analog Devices 功能描述:Dual Input Network Clock Generator/Synchronizer |
| AD9549/PCBZ | 制造商:Analog Devices 功能描述:DUAL INPUT NETWORK CLOCK GEN/SYNCHRONIZER - Bulk |
| AD9549A/PCBZ | 功能描述:BOARD EVALUATION FOR AD9549A RoHS:是 類別:編程器，開發(fā)系統(tǒng) >> 評估演示板和套件 系列:- 標(biāo)準(zhǔn)包裝:1 系列:PSoC® 主要目的:電源管理，熱管理 嵌入式:- 已用 IC / 零件:- 主要屬性:- 次要屬性:- 已供物品:板，CD，電源 |
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