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參數(shù)資料
| 型號： | ADSP-21469KBCZ-4 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 15/72頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP 32/40BIT 450MHZ 324BGA |
| 產品變化通告： | Pin Function Change 08/Mar/2012 |
| 標準包裝： | 1 |
| 系列： | SHARC® |
| 類型： | 浮點 |
| 接口： | DAI，DPI，EBI/EMI，I²C，SCI，SPI，SSP，UART/USART |
| 時鐘速率： | 450MHz |
| 非易失內存： | 外部 |
| 芯片上RAM： | 5Mb |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 1.10V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 324-BGA，CSPBGA |
| 供應商設備封裝： | 324-CSPBGA |
| 包裝： | 托盤 |
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Rev. 0
|
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|
June 2010
ADSP-21469
Figure 5. Core Clock and System Clock Relationship to CLKIN
LOOP
FILTER
CLKIN
PCLK
DDR2_CLK
DDR2
DIVIDER
B
YP
A
S
M
U
X
DIVIDE
BY 2
CCLK
BY
P
A
S
M
U
X
PLL
XTAL
CLKIN
DIVIDER
RESETOUT
RESET
BUF
VCO
BUF
PLLI
CLK
PLL
DIVIDER
CLK_CFGx/PMCTL (2xPLLM)
PIN
MUX
RESETOUT
CLKOUT (TEST ONLY)
DELAY OF
4096 CLKIN
CYCLES
CORERST
CCLK
PCLK
CLK_CFGx/
PMCTL
LINK PORT
CLOCK
DIVIDER
LCLK
B
Y
P
A
S
M
U
X
PMCTL
(PLLBP)
PMCTL
(PLLBP)
PMCTL
(INDIV)
PMCTL
(LCLKR)
PMCTL
(DDR2CKR)
PMCTL
(PLLD)
PLL
MULTIPLIER
f
INPUT
f
CCLK
相關PDF資料 |
PDF描述 |
|---|---|
| TAJB105M035ANJ | CAP TANT 1UF 35V 20% 1210 |
| YNV12T05-G | CONVERTER DC-DC 12V 5A SIP |
| VE-2W1-CY-F3 | CONVERTER MOD DC/DC 12V 50W |
| ADSP-21469KBCZ-3 | IC DSP 32/40BIT 400MHZ 324BGA |
| DS1620S+ | IC THERMOMETER/STAT DIG 8-SOIC |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| ADSP21469KBCZENG | 制造商:Analog Devices 功能描述: |
| ADSP-21469KBCZ-ENG | 制造商:Analog Devices 功能描述:FXD PT PROC - Trays |
| ADSP-21469KBCZ-X | 制造商:Analog Devices 功能描述:FXD PT PROC - Trays |
| ADSP-21469KBZ-EN | 制造商:Analog Devices 功能描述: |
| ADSP-21469KBZ-ENG | 制造商:Analog Devices 功能描述:DSP FLOATING PT 32-BIT/40-BIT 450MHZ 450MIPS - Trays |
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