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參數(shù)資料
| 型號： | AM79C974 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | PCnetTM-SCSI Combination Ethernet and SCSI Controller for PCI Systems |
| 中文描述： | PCnetTM -的SCSI結(jié)合以太網(wǎng)和SCSI控制器PCI系統(tǒng) |
| 文件頁數(shù)： | 27/153頁 |
| 文件大?。?/td> | 838K |
| 代理商： | AM79C974 |
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P R E L I M I N A R Y
AMD
27
Am79C974
DETAILED FUNCTIONS
Bus Interface Unit (BIU)
The bus interface unit is built of several state machines
that run synchronously to CLK. One bus interface unit
state machine handles accesses where the Am79C974
controller is the bus slave, and another handles ac-
cesses where the Am79C974 controller is the bus mas-
ter. All inputs are synchronously sampled. All outputs
are synchronously generated on the rising edge of CLK.
In the descriptions that follow,
GNT
,
REQ
,
INT
, and
IDSEL
are used to refer to the set of
GNTA
,
REQA
,
INTA
, and IDSELA for the SCSI controller and to the set
of
GNTB
,
REQB
,
INTB
, and IDSELB for the Ethernet
Controller, respectively.
Slave Configuration Transfers
The host can access the Am79C974 PCI configuration
space with a configuration read or write command. The
Am79C974 controller will assert
DEVSEL
if the IDSEL
input is asserted during the address phase and if the ac-
cess is a configuration cycle.
DEVSEL
is asserted two
clock cycles after the host has asserted
FRAME
. All
configuration cycles are of fixed length. The Am79C974
controller will assert
TRDY
on the 3rd clock of the
dataphase.
Slave Configuration Read
The Slave Configuration Read command is used by the
host CPU to read the configuration space in the
Am79C974 controller. This provides the host CPU with
information concerning the device and its capabilities.
This is a single cycle, non-burst 8-bit, 16-bit, or 32-bit
transfer.
18681A-5
FRAME
CLK
AD
IRDY
TRDY
C/
BE
1
2
3
4
5
6
ADDR
DATA
1010
BE
's
PAR
PAR
PAR
DEVSEL
IDSEL
STOP
Figure 1.
Slave Configuration Read
相關(guān)PDF資料 |
PDF描述 |
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