參數(shù)資料
型號(hào)： CY8C24123
英文描述： Embedded Processors and Controllers
中文描述： 嵌入式處理器和控制器
文件頁數(shù)： 251/322頁
文件大?。?/td> 3134K
代理商： CY8C24123
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December 22, 2003
Document No. 38-12011 Rev. *E
251
CY8C24xxx Preliminary Data Sheet
Switched Capacitor Block
Figure 22-2. Analog Switch Cap Type D PSoC Blocks
22.2
Application Description
The Analog Switched Capacitor blocks support Delta-
Sigma, Successive Approximation, and Incremental A/D
Conversion, Capacitor DACs, and SC filters. They have
three input arrays of binary-weighted switched capacitors,
allowing user programmability of the capacitor weights. This
provides summing capability of two (CDAC) scaled inputs
and a non-switched capacitor input.
The non-switched capacitor node is labeled “BQTAP” in the
figure above. The local connection of BQTAP is between
horizontal neighboring SC blocks within an analog bi-column
in the CY8C24xxx. Since the input of SC Block C has this
additional switched capacitor, it is configured for the input
stage of such a switched capacitor biquad filter. When fol-
lowed by an SC Block D Integrator, this combination of
blocks can be used to provide a full Switched Capacitor
biquad.
22.3
Register Definitions
The
X
Cap field is used to store the binary encoded value for
capacitor
X
, where
X
can be A (ACap), B (BCap), or C
(CCap), in both the ASCxxCRx and ASDxxCRx registers.
Figure 22-3
illustrates the switch settings for the example
ACap[4:0]=14h=10100b=20d.
Figure 22-3. Example Switch Capacitor Settings
φ
1
* FSW0
Power
φ
1
*BSW
φ
2
+!BSW
BMuxSCD
B Inputs
BQTAP
CCap
BCap
ACap
FCap
16,32 C
φ
1
*AutoZero
(φ
2
+!AutoZero)
* FSW1
φ
2
+AutoZero
φ
1
*BSW*!AutoZero
φ
2
+!BSW+AutoZero
ABUS
AnalogBus*
φ
2
B
OUT
φ
*
!AutoZero
φ
2
φ
1
A Inputs
ASign
ARefMux
RefHi
RefLo
AGND
A Mux
0,1,…,30,31 C
0,1,…,30,31 C
0,1,…,30,31 C
CBUS
CBUS
Driver
φ
2
φ
1
(Comparator)
16C
8C
4C
2C
1C
AGND
AGND
1
0
0
0
AGND
1
AGND
AGND
BOTTOM
TOP
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