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參數(shù)資料
| 型號： | GT-64010A |
| 廠商： | Galileo Technology Services, LLC |
| 英文描述： | System Controller with PCI Interface for R4XXX/ R5000 Family CPUs(帶PCI接口用于R4XXX/ R5000 系列 CPUs的系統(tǒng)控制器) |
| 中文描述： | 系統(tǒng)控制器的PCI R4XXX接口/ R5000系列處理器（帶的PCI接口用于R4XXX / R5000系列處理器的系統(tǒng)控制器） |
| 文件頁數(shù)： | 109/111頁 |
| 文件大小： | 671K |
| 代理商： | GT-64010A |
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GT-64010A System Controller with PCI Interface for R4XXX/R5000 Family CPUs
97
Rev is io n 1. 1
Galileo
TechnologyTM
10.2.4. 32-bit or Less Devices
It is optional to have one bidirectional buffer.
Notes:
1. dev_adr[21:0] is the output of the latch connected to AD[23:2], sampled by ALE
2. Bidirectional latch is optional for buffering, and either odd or even bank can be chosen. This example shows an even
bank connection.
3. Regardless of endianess,
EWr[0]* always corresponds to SysAD[7:0] and AD[7:0] regardless of endianess.
EWr[1]* always corresponds to SysAD[15:8] and AD[15:8] regardless of endianess.
EWr[2]* always corresponds to SysAD[23:16] and AD[23:16] regardless of endianess.
EWr[3]* always corresponds to SysAD[31:24] and AD[31:24] regardless of endianess.
4. Be careful if OEB is programmed at reset to have reverse polarity.
Connection
Memory
Width
Connect...
To...
Device Address
1
32-bit
16-bit
8-bit
{dev_adr[21:2], DAdr[2:0]}
{dev_adr[21:0], DAdr[2:1]}
{dev_adr[21:0], DAdr[2:0]}
Device address pins
Device Data
(Latched)
2,3
32-bit or
less
AD[31:0] or [15:0] or [7:0]
Even latch I/Os B side
‘0’
LEE
OEE*
OEB
3
Even latch I/Os A side
Even bank data pins
Even latch CLKAB and CLKBA
Even latch LEAB and LEBA
Even latch OEBA*
Even latch OEAB
Device Data
(No Latch)
32-bit or
less
AD[31:0] or [15:0] or [7:0]
Device data pins
Device Control
32-bit or
less
AD[31:0]
ALE
Control latch bit[0] output
Control latch bit[1] output
Control latch bit[23:2] outputs
Control latch bit[27:24] outputs
Control latch bit[31:28] outputs
Control latch inputs
Control latch LE
Becomes BootCS*
Becomes DevRW*
Becomes dev_adr [21:0]
Becomes DMAAck[3:0]*
Becomes CS[3:0]*
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