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參數(shù)資料
| 型號： | GT-64010A |
| 廠商： | Galileo Technology Services, LLC |
| 英文描述： | System Controller with PCI Interface for R4XXX/ R5000 Family CPUs(帶PCI接口用于R4XXX/ R5000 系列 CPUs的系統(tǒng)控制器) |
| 中文描述： | 系統(tǒng)控制器的PCI R4XXX接口/ R5000系列處理器（帶的PCI接口用于R4XXX / R5000系列處理器的系統(tǒng)控制器） |
| 文件頁數(shù)： | 70/111頁 |
| 文件大?。?/td> | 671K |
| 代理商： | GT-64010A |
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GT-64010A System Controller with PCI Interface for R4XXX/R5000 Family CPUs
61
Rev is io n 1. 1
Galileo
TechnologyTM
Notes:
1. All Delays, Setup, and Hold times are referred to TClk rising edge, unless stated otherwise.
2. All outputs are specified for 50pF load except: WrRdy*, ValidIn*, ALE, LEAdrO, LEAdrE/DMAReq[2]* - 30pF, Inter-
rupt* - 20 pF.
3. TClk frequency must be equal or greater than PClk frequency.
4. Maximum allowable TClk to PClk skew in sync. mode is 2nS.
Symbol
Signals
Description
Min
Max
Unit
PClk, Frame*, IRdy*,
TRdy*, DevSel*, Stop*,
PErr*, Par, PAD[31:0],
CBE[3:0]*, Gnt*, IdSel,
Lock*, Req*, SErr*, Int*
See PCI Specification Rev. 2.1. Referred to PClk.
All Inputs including
JTRST*, JTDI, JTMS
Setup to JTCLK
12
nS
All Inputs including
JTRST*, JTDI, JTMS
Hold from JTCLK
1
nS
All Outputs
Delay from JTCLK
Float to Valid delay
Drive to Float delay
2
10
15
nS
JTDO
Delay from JTCLK falling
2
10
nS
相關(guān)PDF資料 |
PDF描述 |
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