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參數(shù)資料
| 型號(hào)： | HD6437020VXI |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | SuperH⑩ RISC engine |
| 中文描述： | ⑩的SuperH RISC引擎 |
| 文件頁(yè)數(shù)： | 240/507頁(yè) |
| 文件大?。?/td> | 1311K |
| 代理商： | HD6437020VXI |
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226 HITACHI
10.2.2
Timer Synchro Register (TSNC)
The timer synchro register (TSNC) is an eight-bit read/write register that selects timer
synchronizing modes for channels 0–4. Channels for which 1 is set to the corresponding bit will be
synchronized. TSNC is initialized to H'E0 or H'60 upon reset or standby mode.
Bit:
7
6
5
4
3
2
1
0
Bit name:
—
—
—
SYNC4
SYNC3
SYNC2
SYNC1
SYNC0
Initial value:
*
1
—
1
—
0
0
0
0
0
R/W:
—
R/W
R/W
R/W
R/W
R/W
Note:
Undefined
Bits 7–5 (reserved): Bit 7 is read as undefined. Bits 6 and 5 are always read as 1. The write
value to bit 7 should be 0 or 1, and the write value to bits 6 and 5 should always be 1.
Bit 4 (timer synchro 4 (SYNC4)): SYNC4 selects the synchronizing mode for channel 4.
Bit 4: SYNC4
Description
0
The timer counter for channel 4 (TCNT4) operates independently
(Preset/clear of TCNT4 is independent of other channels) (initial value)
1
Channel 4 operates synchronously. Synchronized preset/clear of
TNCT4 enabled.
Bit 3 (timer Synchro 3 (SYNC3)): SYNC3 selects the synchronizing mode for channel 3.
Bit 3: SYNC3
Description
0
The timer counter for channel 3 (TCNT3) operates independently
(Preset/clear of TCNT3 is independent of other channels) (initial value)
1
Channel 3 operates synchronously. Synchronized preset/clear of
TNCT3 enabled.
Bit 2 (timer synchro 2 (SYNC2)): SYNC2 selects the synchronizing mode for channel 2.
Bit 2: SYNC2
Description
0
The timer counter for channel 2 (TCNT2) operates independently
(Preset/clear of TCNT2 is independent of other channels) (initial value)
1
Channel 2 operates synchronously. Synchronized preset/clear of
TNCT2 enabled.
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