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參數(shù)資料
| 型號(hào)： | HD6437020VXI |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | SuperH⑩ RISC engine |
| 中文描述： | ⑩的SuperH RISC引擎 |
| 文件頁(yè)數(shù)： | 427/507頁(yè) |
| 文件大小： | 1311K |
| 代理商： | HD6437020VXI |
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HITACHI 416
Table 15.1
Port A Register
Name
Abbreviation
R/W
Initial Value
Address
Access Size
Port A data register
PADR
R/W
H'0000
H'5FFFFC0
8, 16, 32
15.2.2
Port A Data Register (PADR)
PADR is a 16-bit read/write register that stores data for port A. The bits PA15DR–PA0DR
correspond to the PA15/
IRQ3
/
DREQ1
–PA0/
CS4
/TIOCA0 pins. When the pins are used as
ordinary outputs, they will output whatever value is written in the PADR; when PADR is read, the
register value will be output regardless of the pin status. When the pins are used as ordinary
inputs, the pin status rather than the register value is read directly when PADR is read. When a
value is written to PADR, that value can be written into PADR, but it will not affect the pin status.
Table 15.2 shows the read/write operations of the port A data register.
PADR is initialized by a power-on reset. However, PADR is not initialized for manual reset,
standby mode, or sleep mode.
Bit:
15
14
13
12
11
10
9
8
Bit name:
PA15DR PA14DR PA13DR PA12DR PA11DR PA10DR PA9DR
PA8DR
Initial value:
0
0
0
0
0
0
0
0
R/W:
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Bit:
7
6
5
4
3
2
1
0
Bit name:
PA7DR
PA6DR
PA5DR
PA4DR
PA3DR
PA2DR
PA1DR
PA0DR
Initial value:
0
0
0
0
0
0
0
0
R/W:
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Table 15.2
Read/Write Operation of the Port A Data Register (PADR)
PAIOR
Pin Status
Read
Write
0
Input
Pin status
Can write to PADR, but it has no effect on pin
status.
Other function
Pin status
Can write to PADR, but it has no effect on pin
status.
1
Output
PADR value
Value written is output by pin
Other function
PADR value
Can write to PADR, but it has no effect on pin
status.
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