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參數(shù)資料
| 型號(hào)： | ISP1362EE,551 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PBGA64 |
| 封裝： | 6 X 6 MM, 0.80 HEIGHT, PLASTIC, MO-195, SOT-543-1, TFBGA-64 |
| 文件頁數(shù)： | 107/152頁 |
| 文件大?。?/td> | 677K |
| 代理商： | ISP1362EE,551 |
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ISP1362_5
NXP B.V. 2007. All rights reserved.
Product data sheet
Rev. 05 — 8 May 2007
58 of 152
NXP Semiconductors
ISP1362
Single-chip USB OTG Controller
12.4.3.2
Isochronous endpoints
A DMA transfer to or from an isochronous endpoint can be terminated by any of the
following conditions (bit names refer to the DcDMAConguration register, see Table 119
and Table 120):
The DMA transfer completes as programmed in the DcDMACounter register
(CNTREN = 1).
An End-Of-Packet (EOP) signal is detected.
DMA operation is disabled by clearing bit DMAEN.
12.5 ISP1362 Peripheral Controller suspend and resume
12.5.1 Suspend conditions
The Peripheral Controller in the ISP1362 detects a USB suspend condition in either of the
following cases:
Constant idle state is present on the USB bus for 3 ms.
VBUS is lost.
Bus-powered devices that are suspended must not consume more than 500
A of current.
This is achieved by shutting down the power to system components or supplying them
with a reduced voltage.
The steps leading the Peripheral Controller to the suspend state are as follows:
1. In the event of no SOF for 3 ms, the Peripheral Controller in the ISP1362 sets
bit SUSPND of the DcInterrupt register. This will generate an interrupt if bit IESUSP of
the DcInterruptEnable register is set.
2. When the rmware detects a suspend condition (through IESUSP), it must prepare all
system components for the suspend state:
a. All the signals connected to the Peripheral Controller in the ISP1362 must enter
appropriate states to meet the power consumption requirements of the suspend
state.
b. All the input pins of the Peripheral Controller in the ISP1362 must have a CMOS
logic 0 or logic 1 level.
3. In the interrupt service routine, the rmware must check the current status of the USB
bus. When bit BUSTATUS of the DcInterrupt register is logic 0, the USB bus has left
suspend mode and the process must be aborted. Otherwise, the next step can be
executed.
4. To meet the suspend current requirements for a bus-powered device, internal clocks
must be switched off by clearing bit CLKRUN of the DcHardwareConguration
register.
5. When rmware has set and cleared the GOSUSP bit of the DcMode register, the
Peripheral Controller in the ISP1362 enters the suspend state. It sets the
D_SUSPEND/D_WAKEUP pin to HIGH and switches off internal clocks after 2 ms.
Table 20.
Recommended EOT usage for isochronous endpoints
EOT condition
OUT endpoint
IN endpoint
DcDMACounter register zero
do not use
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