參數資料
型號： MPC563MZP66R2
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 66 MHz, RISC MICROCONTROLLER, PBGA388
封裝： 27 X 27 MM, 1 MM PITCH, PLASTIC, MO-151, BGA-388
文件頁數： 1410/1496頁
文件大?。?/td> 20425K
代理商： MPC563MZP66R2
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21-28
MPC561/MPC563 Reference Manual
MOTOROLA
UC3F Operation
if EPEE = 0 or B0EPEE = 0, no erase voltages will be applied to the array or the block
corresponding to block 0 or small block 0 if SBEN[0] = 1.
The embedded program/erase algorithm first pre-programs all bits in blocks selected for
erase prior to actually erasing the selected blocks.
The array blocks selected for erase operation are determined by BLOCK[0:7],
SBBLOCK[0:1] in conjunction with SBEN[0:1], and the array configuration. If multiple
blocks are selected for erase, the embedded erase hardware algorithm serially erases each
array block until all of the selected blocks are erased. For instance, if BLOCK[0:7] = 0x78
and SBEN[0:1] = 0b00, then blocks 1, 2, 3, and 4 are selected for erase. The embedded
erase hardware algorithm first erases block 1 and then erases block 2 followed by blocks 3
and 4. The total erase time for this example is the block erase time, TERASE, multiplied by
four since four blocks are erased. In addition, the preprogramming time to program all
locations in blocks 1, 2, 3, and 4 to a “0” state needs to be considered when determining the
total erase time. The preprogramming time is dependent on the data already stored in the
Flash array before beginning the erase operation.
21.3.8.1 Erase Sequence
The UC3F EEPROM module requires a sequence of writes to the high voltage control
register (UC3FCTL) and an erase interlock write in order to enable high voltage to the array
and shadow information for erase operation. The required hardware algorithm erase
sequence follows.
1. Write PROTECT[0:7] and SBPROTECT[0:1] to disable protect for the blocks to be
erased.
2. Write BLOCK[0:7] and SBBLOCK[0:1] to select the blocks to be erased, PE = 1
and SES = 1 in the UC3FCTL register.
NOTE
BLOCK[0:7] and SBBLOCK[0:1] in conjunction with
SBEN[0:1] determine which blocks are selected for erase.
Blocks whose BLOCK bits or enabled small blocks whose
SBBLOCK bits are set (equal to 1) get erased when an erase
operation is performed.
3. Execute an erase interlock write to any UC3F array location.
4. Write EHV = 1 in the UC3FCTL register.
NOTE
The values of the EPEE and B0EPEE inputs are latched with
the assertion of EHV to determine the array protection state for
the erase operation. It is assumed that the EPEE and B0EPEE
inputs are setup prior to the assertion of EHV.
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