參數(shù)資料
型號： MPC563MZP66R2
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 66 MHz, RISC MICROCONTROLLER, PBGA388
封裝： 27 X 27 MM, 1 MM PITCH, PLASTIC, MO-151, BGA-388
文件頁數(shù)： 21/1496頁
文件大?。?/td> 20425K
代理商： MPC563MZP66R2
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24-12
MPC561/MPC563 Reference Manual
MOTOROLA
Programming Model
Table 24-8 describes the DC register fields with the mode configurations for RCPU
development access.
24.6.1.5 Mode Control Register (MC)
The MC register is used to select different modes of the READI module. Table 24-7 shows
the location of register bits.
NOTE
The MC register is not available prior to Revision D of the
MPC561 and is not available in Revision B and earlier versions
of the MPC563. Prior revisions have only the default features.
3:5
4:2
TM
READI Trace Mode Field can be configured to enable BTM, DTM, and OTM. Any or
all types of trace may be enabled.
000 No Trace
1xx BTM Branch Trace Messaging Enabled
x1x DTM Data Trace Messaging Enabled
xx1 OTM Ownership Trace Messaging Enabled
6:7
1:0
EC
READI EVTI Control Field can be configured for synchronization and breakpoint
generation. If the EC is equal to 0b00, asserting EVTI will cause the next program and
data trace message to be a synchronization message (providing program and data
trace are enabled). If the EC field is equal to 0b01, a breakpoint will be generated. If
the field is configured to one of the reserved states, its action reverts to that of the
default state.
NOTE: The EVTI signal is level sensitive when EC is configured for breakpoint
generation. This implies that as long as EVTI assertion is continued (with EC set to
0b01), the READI module will continue requesting a breakpoint. The user must detect
breakpoint generation and negate the EVTI signal appropriately.
00 EVTI for program and data trace synchronization
01 EVTI for breakpoint generation
1x No Action
1 The DOR and DME fields in the DC register can only be modified when system reset is asserted, or reset (to default
state) when the READI module is reset by the assertion of RSTI.
Table 24-8. RCPU Development Access Modes
DOR
DME
RCPU Development Access through READI
x
0
Non-debug mode access of RCPU development through READI.
0
1
Debug mode is enabled through READI (RCPU is still in normal mode, out
of reset)
1
Debug mode is enabled through READI and entered out-of-reset. Debug
mode entry causes RCPU to halt.
Table 24-7. DC Bit Descriptions (continued)
RCPU
Bits
Nexus
Bits
Name
Description
相關PDF資料
PDF描述
MPC564MVR56R2 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
MPC561MZP56R2 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
MPC561MZP66 32-BIT, 66 MHz, RISC MICROCONTROLLER, PBGA388
MPC563CZP40 32-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PBGA388
MPC564MZP56 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
相關代理商/技術參數(shù)
參數(shù)描述
MPC564 制造商:未知廠家 制造商全稱:未知廠家 功能描述:NEXUS Debugger and Trace for PowerPC
MPC5642A 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Qorivva MPC5642A Microcontroller
MPC5643L 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5643L Microcontroller Data Sheet
MPC5643L_11 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:High-performance e200z4d dual core
MPC5643L_12 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Qorivva Microcontroller
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