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參數(shù)資料
| 型號： | TFRA08C13 |
| 廠商： | Lineage Power |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 107/188頁 |
| 文件大?。?/td> | 3047K |
| 代理商： | TFRA08C13 |
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Lucent Technologies Inc.
107
Preliminary Data Sheet
October 2000
TFRA08C13 OCTAL T1/E1 Framer
JTAG Boundary-Scan Specification
(continued)
Test Access Port Controller
The test access port controller is a synchronous sequence controller with 16 states. The state changes are preset
by the TMS, TCK, and TRST signals and by the previous state. The state changes always take place when the
TCK edge rises. Figure 45 shows the TAP controller state diagram.
5-3924(F)r.5
Figure 45. BS TAP Controller State Diagram
The value shown next to each state transition in Figure 45 represents the signal present at TMS at the time of a ris-
ing edge at TCK.
The description of the TAP controller states is given in IEEEStd. 1149.1-1990 Section 5.1.2 and is reproduced in
Table 49 and Table 50.
SELECT-DR
CAPTURE-DR
1
0
0
1
1
SHIFT-DR
EXIT1-DR
PAUSE-DR
0
1
EXIT2-DR
UPDATE-DR
1
1
0
0
0
0
TEST LOGIC
RESET
RUN TEST/
IDLE
1
0
SELECT-IR
CAPTURE-IR
1
0
0
1
1
SHIFT-IR
EXIT1-IR
PAUSE-IR
0
1
EXIT2-IR
UPDATE-IR
1
1
0
0
0
0
TRST = 0
0
1
1
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PDF描述 |
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