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參數(shù)資料
| 型號： | TMDXCNCD28069ISO |
| 廠商： | Texas Instruments |
| 文件頁數(shù)： | 172/174頁 |
| 文件大?。?/td> | 0K |
| 描述： | EVAL PICCOLO CONTROLCARD |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | TMS320F2806x, Piccolo™, C2000™ |
| 主要目的： | 接口，RS232，GPIO |
| 嵌入式： | 是，MCU，32 位 |
| 已用 IC / 零件： | TMS320F2806x |
| 已供物品： | 板 |
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1)
(SPIBRR
LSPCLK
rate
Baud
+
=
127
to
3
SPIBRR
when
=
4
LSPCLK
rate
Baud
=
2
1,
0,
SPIBRR
when
=
SPRS698D – NOVEMBER 2010 – REVISED DECEMBER 2012
5.12 Serial Peripheral Interface (SPI) Module
The device includes the four-pin serial peripheral interface (SPI) module. Up to two SPI modules are
available. The SPI is a high-speed, synchronous serial I/O port that allows a serial bit stream of
programmed length (one to sixteen bits) to be shifted into and out of the device at a programmable bit-
transfer rate. Normally, the SPI is used for communications between the MCU and external peripherals or
another processor. Typical applications include external I/O or peripheral expansion through devices such
as shift registers, display drivers, and ADCs. Multidevice communications are supported by the
master/slave operation of the SPI.
The SPI module features include:
Four external pins:
–
SPISOMI: SPI slave-output/master-input pin
–
SPISIMO: SPI slave-input/master-output pin
–
SPISTE: SPI slave transmit-enable pin
–
SPICLK: SPI serial-clock pin
NOTE: All four pins can be used as GPIO if the SPI module is not used.
Two operational modes: master and slave
Baud rate: 125 different programmable rates.
Data word length: one to sixteen data bits
Four clocking schemes (controlled by clock polarity and clock phase bits) include:
–
Falling edge without phase delay: SPICLK active-high. SPI transmits data on the falling edge of the
SPICLK signal and receives data on the rising edge of the SPICLK signal.
–
Falling edge with phase delay: SPICLK active-high. SPI transmits data one half-cycle ahead of the
falling edge of the SPICLK signal and receives data on the falling edge of the SPICLK signal.
–
Rising edge without phase delay: SPICLK inactive-low. SPI transmits data on the rising edge of the
SPICLK signal and receives data on the falling edge of the SPICLK signal.
–
Rising edge with phase delay: SPICLK inactive-low. SPI transmits data one half-cycle ahead of the
falling edge of the SPICLK signal and receives data on the rising edge of the SPICLK signal.
Simultaneous receive and transmit operation (transmit function can be disabled in software)
Transmitter and receiver operations are accomplished through either interrupt-driven or polled
algorithms.
Nine SPI module control registers: Located in control register frame beginning at address 7040h.
NOTE
All registers in this module are 16-bit registers that are connected to Peripheral Frame 2.
When a register is accessed, the register data is in the lower byte (7–0), and the upper byte
(15–8) is read as zeros. Writing to the upper byte has no effect.
Enhanced feature:
4-level transmit/receive FIFO
Delayed transmit control
Bi-directional 3 wire SPI mode support
Audio data receive support via SPISTE inversion
Copyright 2010–2012, Texas Instruments Incorporated
Peripheral and Electrical Specifications
97
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