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參數(shù)資料
| 型號(hào)： | TMX320DM6443AZWT |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Digital Media System-on-Chip |
| 中文描述： | 數(shù)字媒體系統(tǒng)片上 |
| 文件頁數(shù)： | 2/221頁 |
| 文件大小： | 1582K |
| 代理商： | TMX320DM6443AZWT |
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www.ti.com
1.2 Description
TMS320DM6443
Digital Media System-on-Chip
SPRS282E–DECEMBER 2005–REVISED MARCH 2007
–
Enhanced Direct-Memory-Access (EDMA)
Controller (64 Independent Channels)
Two 64-Bit General-Purpose Timers (Each
Configurable as Two 32-Bit Timers)
One 64-Bit Watch Dog Timer
Three UARTs (One with RTS and CTS Flow
Control)
One Serial Port Interface (SPI) with Two
Chip-Selects
Master/Slave Inter-Integrated Circuit (I
2
C
Bus)
Audio Serial Port (ASP)
–
I2S
–
AC97 Audio Codec Interface
–
Standard Voice Codec Interface (AIC12)
10/100 Mb/s Ethernet MAC (EMAC)
–
IEEE 802.3 Compliant
–
Media Independent Interface (MII)
VLYNQ Interface (FPGA Interface)
Host-Port Interface (HPI) with 16-Bit
Multiplexed Address/Data
SmartMedia
USB Port With Integrated 2.0 PHY
–
USB 2.0 High-/Full-Speed (480 Mbps) Client
–
USB 2.0 High-/Full-/Low-Speed Host
(Mini-Host, Supporting One External
Device)
Three Pulse Width Modulator (PWM) Outputs
On-Chip ARM ROM Bootloader (RBL) to Boot
From NAND Flash or UART
ATA/ATAPI I/F (ATA/ATAPI-6 Specification)
Individual Power-Saving Modes for ARM/DSP
Flexible PLL Clock Generators
IEEE-1149.1 (JTAG) Boundary-
Scan-Compatible
Up to 71 General-Purpose I/O (GPIO) Pins
(Multiplexed With Other Device Functions)
361-Pin Pb-Free BGA Package
(ZWT Suffix), 0.8-mm Ball Pitch
0.09-
μ
m/6-Level Cu Metal Process (CMOS)
3.3-V and 1.8-V I/O, 1.2-V Internal
Applications:
–
Digital Media
–
Networked Media Encode/Decode
–
Video Imaging
The TMS320DM6443 (also referenced as DM6443) leverages TI’s DaVinci technology to meet the
networked media encode and decode application processing needs of next-generation embedded devices.
The DM6443 enables OEMs and ODMs to quickly bring to market devices featuring robust operating
systems support, rich user interfaces, high processing performance, and long battery life through the
maximum flexibility of a fully integrated mixed processor solution.
The dual-core architecture of the DM6443 provides benefits of both DSP and Reduced Instruction Set
Computer (RISC) technologies, incorporating a high-performance TMS320C64x+ DSP core and an
ARM926EJ-S core.
The ARM926EJ-S is a 32-bit RISC processor core that performs 32-bit or 16-bit instructions and
processes 32-bit, 16-bit, or 8-bit data. The core uses pipelining so that all parts of the processor and
memory system can operate continuously.
The ARM core incorporates:
A coprocessor 15 (CP15) and protection module
Data and program Memory Management Units (MMUs) with table look-aside buffers.
Separate 16K-byte instruction and 8K-byte data caches. Both are four-way associative with virtual
index virtual tag (VIVT).
The
TMS320C6000 DSP platform. It is based on an enhanced version of the second-generation
high-performance,
advanced
very-long-instruction-word
Instruments (TI), making these DSP cores an excellent choice for digital media applications. The C64x is a
code-compatible member of the C6000 DSP platform. The TMS320C64x+ DSP is an enhancement of
the C64x+ DSP with added functionality and an expanded instruction set.
TMS320C64x+
DSPs
are
the
highest-performance
fixed-point
DSP
generation
in
the
(VLIW)
architecture
developed
by
Texas
Digital Media System-on-Chip (DMSoC)
2
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