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參數(shù)資料
| 型號： | TMX320DM6443AZWT |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Digital Media System-on-Chip |
| 中文描述： | 數(shù)字媒體系統(tǒng)片上 |
| 文件頁數(shù)： | 204/221頁 |
| 文件大?。?/td> | 1582K |
| 代理商： | TMX320DM6443AZWT |
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www.ti.com
6.20.2
EMAC Electrical Data/Timing
MRCLK
2
3
1
MTCLK
2
3
1
TMS320DM6443
Digital Media System-on-Chip
SPRS282E–DECEMBER 2005–REVISED MARCH 2007
Table 6-85. EMAC Control Module Registers
HEX ADDRESS RANGE
0x01C8 1004
0x01C8 1008
ACRONYM
EWCTL
EWINTTCNT
REGISTER NAME
Interrupt control register
Interrupt timer count
Table 6-86. EMAC Control Module RAM
HEX ADDRESS RANGE
0x01C8 2000 - 0x01C8 3FFF
ACRONYM
REGISTER NAME
EMAC Control Module Descriptor Memory
Table 6-87. Timing Requirements for MRCLK (see
Figure 6-64
)
-594
NO.
UNIT
MIN
40
14
14
MAX
1
2
3
t
c(MRCLK)
t
w(MRCLKH)
t
w(MRCLKL)
Cycle time, MRCLK
Pulse duration, MRCLK high
Pulse duration, MRCLK low
ns
ns
ns
Figure 6-64. MRCLK Timing (EMAC - Receive)
Table 6-88. Timing Requirements for MTCLK (see
Figure 6-64
)
-594
NO.
UNIT
MIN
40
14
14
MAX
1
2
3
t
c(MTCLK)
t
w(MTCLKH)
t
w(MTCLKL)
Cycle time, MTCLK
Pulse duration, MTCLK high
Pulse duration, MTCLK low
ns
ns
ns
Figure 6-65. MTCLK Timing (EMAC - Transmit)
Table 6-89. Timing Requirements for EMAC MII Receive 10/100 Mbit/s
(1)
(see
Figure 6-66
)
-594
NO.
UNIT
MIN
MAX
1
t
su(MRXD-MRCLKH)
Setup time, receive selected signals valid before MRCLK high
8
ns
(1)
Receive selected signals include: MRXD3-MRXD0, MRXDV, and MRXER.
Peripheral and Electrical Specifications
204
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相關PDF資料 |
PDF描述 |
|---|---|
| TMX320DM6443ZWT | Digital Media System-on-Chip |
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| TMS320DM647ZUT720 | Digital Media Processor |
| TMS320DM647ZUT900 | Digital Media Processor |
| TMS320DM648ZUT720 | Digital Media Processor |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| TMX320DM6443CZWT | 制造商:Texas Instruments 功能描述: |
| TMX320DM6443ZWT | 制造商:Texas Instruments 功能描述: |
| TMX320DM6444AZWT | 制造商:Texas Instruments 功能描述:TMS320DM6443, TMS320DM6444 DIGITAL MEDIA SOC DATA SHEET - Trays |
| TMX320DM6446AZWT | 制造商:Texas Instruments 功能描述: |
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