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參數(shù)資料
| 型號： | TMX320DM6443AZWT |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Digital Media System-on-Chip |
| 中文描述： | 數(shù)字媒體系統(tǒng)片上 |
| 文件頁數(shù)： | 42/221頁 |
| 文件大?。?/td> | 1582K |
| 代理商： | TMX320DM6443AZWT |
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www.ti.com
TMS320DM6443
Digital Media System-on-Chip
SPRS282E–DECEMBER 2005–REVISED MARCH 2007
Table 2-18. VLYNQ Terminal Functions
SIGNAL
NAME
TYPE
(1)
OTHER
(2)
DESCRIPTION
NO.
VLYNQ
EM_CS5/
GPIO8/
VLYNQ_CLOCK
EM_CS4/
GPIO9/
VLYNQ_SCRUN
EM_A[15]/
GPIO16/
VLYNQ_TXD3
EM_A[17]/
GPIO14/
VLYNQ_TXD2
EM_A[19]/
GPIO12/
VLYNQ_TXD1
EM_A[21]/
GPIO10/
VLYNQ_TXD0
EM_A[14]/
GPIO17/
VLYNQ_RXD3
EM_A[16]/
GPIO15/
VLYNQ_RXD2
EM_A[18]/
GPIO13/
VLYNQ_RXD1
EM_A[20]/
GPIO11/
VLYNQ_RXD0
This pin is multiplexed between EMIFA, GPIO, and VLYNQ.
For VLYNQ, it is the clock (VLYNQ_CLOCK).
T1
I/O/Z
DV
DD18
This pin is multiplexed between EMIFA, GPIO, and VLYNQ.
For VLYNQ, it is the Serial Clock run request (VLYNQ_SCRUN).
T2
I/O/Z
DV
DD18
This pin is multiplexed between EMIFA, GPIO, and VLYNQ.
For VLYNQ, it is transmit bus bit 3 output VLYNQ_TXD3.
P3
I/O/Z
DV
DD18
This pin is multiplexed between EMIFA, GPIO, and VLYNQ.
For VLYNQ, it is transmit bus bit 2 output VLYNQ_TXD2.
R2
I/O/Z
DV
DD18
This pin is multiplexed between EMIFA, GPIO, and VLYNQ.
For VLYNQ, it is transmit bus bit 1 output VLYNQ_TXD1.
R4
I/O/Z
DV
DD18
This pin is multiplexed between EMIFA, GPIO, and VLYNQ.
For VLYNQ, it is bit 0 of the transmit bus (VLYNQ_TXD0).
T3
I/O/Z
DV
DD18
This pin is multiplexed between EMIFA, GPIO, and VLYNQ.
For VLYNQ, it is receive bus bit 3 input VLYNQ_RXD3.
P4
I/O/Z
DV
DD18
This pin is multiplexed between EMIFA, GPIO, and VLYNQ.
For VLYNQ, it is receive bus bit 2 input VLYNQ_RXD2.
R5
I/O/Z
DV
DD18
This pin is multiplexed between EMIFA, GPIO, and VLYNQ.
For VLYNQ, it is receive bus bit 1 input VLYNQ_RXD1.
P5
I/O/Z
DV
DD18
This pin is multiplexed between EMIFA, GPIO, and VLYNQ.
For VLYNQ, it is receive bus bit 0 input VLYNQ_RXD0.
R3
I/O/Z
DV
DD18
(1)
(2)
I = Input, O = Output, Z = High impedance, S = Supply voltage, GND = Ground, A = Analog signal
Specifies the operating I/O supply voltage for each signal
Device Overview
42
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