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參數(shù)資料
| 型號： | XC3S400AN-5FTG256C |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 38/123頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA SPARTAN-3AN 256FTBGA |
| 標準包裝： | 90 |
| 系列： | Spartan®-3AN |
| LAB/CLB數(shù)： | 896 |
| 邏輯元件/單元數(shù)： | 8064 |
| RAM 位總計： | 368640 |
| 輸入/輸出數(shù)： | 195 |
| 門數(shù)： | 400000 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 256-LBGA |
| 供應商設(shè)備封裝： | 256-FTBGA |
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Spartan-3AN FPGA Family: DC and Switching Characteristics
DS557 (v4.1) April 1, 2011
Product Specification
21
Table 16: DC Characteristics of User I/Os Using Differential Signal Standards
IOSTANDARD Attribute
VOD
VOCM
VOH
VOL
Min (mV)
Typ (mV)
Max (mV)
Min (V)
Typ (V)
Max (V)
Min (V)
Max (V)
LVDS_25
247
350
454
1.125
–1.375
–
LVDS_33
247
350
454
1.125
–1.375
–
BLVDS_25
240
350
460
–1.30
–
MINI_LVDS_25
300
–600
1.0
–1.4
–
MINI_LVDS_33
300
–600
1.0
–1.4
–
RSDS_25
100
–400
1.0
–1.4
–
RSDS_33
100
–400
1.0
–1.4
–
TMDS_33
400
–800
VCCO – 0.405
–VCCO – 0.190
–
PPDS_25
100
–
400
0.5
0.8
1.4
–
PPDS_33
100
–
400
0.5
0.8
1.4
–
DIFF_HSTL_I_18
–
–VCCO – 0.4
0.4
DIFF_HSTL_II_18
–
–VCCO – 0.4
0.4
DIFF_HSTL_III_18
–
–VCCO – 0.4
0.4
DIFF_HSTL_I
–
–VCCO – 0.4
0.4
DIFF_HSTL_III
–
–VCCO – 0.4
0.4
DIFF_SSTL18_I
–
–VTT + 0.475
VTT – 0.475
DIFF_SSTL18_II
–
–VTT + 0.475
VTT – 0.475
DIFF_SSTL2_I
–
–VTT + 0.61
VTT – 0.61
DIFF_SSTL2_II
–
–VTT + 0.81
VTT – 0.81
DIFF_SSTL3_I
–
–VTT + 0.6
VTT – 0.6
DIFF_SSTL3_II
–
–VTT + 0.8
VTT – 0.8
Notes:
1.
2.
3.
Output voltage measurements for all differential standards are made with a termination resistor (RT) of 100 across the N and P pins of the
differential signal pair.
4.
At any given time, no more than two of the following differential output standards can be assigned to an I/O bank: LVDS_25, RSDS_25,
MINI_LVDS_25, PPDS_25 when VCCO=2.5V, or LVDS_33, RSDS_33, MINI_LVDS_33, TMDS_33, PPDS_33 when VCCO =3.3V
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