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參數(shù)資料
| 型號： | XRT86VL3X |
| 廠商： | Exar Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 80/149頁 |
| 文件大?。?/td> | 1274K |
| 代理商： | XRT86VL3X |
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XRT86VL3X
73
T1/E1/J1 FRAMER/LIU COMBO - ARCHITECTURE DESCRIPTION
REV. 1.2.0
channels are sent, it comes the second bit of Timeslot 0 of Channel 0 and so on. The table below demon-
strates how payload bits of four channels are mapped into the 12.352Mbit/s data stream.
X
Y
: The Xth payload bit of Channel Y
3.
The local Terminal Equipment also multiplexes signaling bits with payload bits and sends them together
through the 12.352Mbit/s data stream. When the Terminal Equipment is sending the fifth payload bit of
each channel, instead of sending it twice, it inserts the signaling bit A of that corresponding channel. Simi-
larly, the sixth payload bit of a each channel is followed by the signaling bit B of that channel; the seventh
payload bit is followed by the signaling bit C; the eighth payload bit is followed by the signaling bit D.
The following table illustrates how payload bits and signaling bits are multiplexed together into the 12.352Mbit/
s data stream.
X
Y
: The Xth payload bit of Channel Y
A
Y
: The signaling bit A of Channel Y
4.
Following the same rules of Step 2 and 3, the local Terminal Equipment continues to map the payload data
and signaling data of four channels into a 12.352Mbit/s data stream.
B
IT
0
B
IT
1
B
IT
2
B
IT
3
B
IT
4
B
IT
5
B
IT
6
B
IT
7
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0
1
0
1
1
1
1
1
2
1
2
1
3
1
3
B
IT
0
B
IT
1
B
IT
2
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IT
3
B
IT
4
B
IT
5
B
IT
6
B
IT
7
2
0
2
0
2
1
2
1
2
2
2
2
2
3
2
3
B
IT
0
B
IT
1
B
IT
2
B
IT
3
B
IT
4
B
IT
5
B
IT
6
B
IT
7
5
0
A
0
5
1
A
1
5
2
A
2
5
3
A
3
B
IT
0
B
IT
1
B
IT
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B
IT
3
B
IT
4
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5
B
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6
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0
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0
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1
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1
6
2
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6
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3
B
IT
0
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IT
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6
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7
7
0
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0
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2
C
2
7
3
C
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IT
0
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B
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0
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1
D
1
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D
2
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D
3
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PDF描述 |
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