參數(shù)資料
型號： DS34T102GN+
廠商： Maxim Integrated Products
文件頁數(shù)： 104/366頁
文件大?。?/td> 0K
描述： IC TDM OVER PACKET 484TEBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 30
類型： TDM（分時復(fù)用）
應(yīng)用： 數(shù)據(jù)傳輸
安裝類型： 表面貼裝
封裝/外殼： 484-BGA 裸露焊盤
供應(yīng)商設(shè)備封裝： 484-HSBGA（23x23）
包裝： 托盤
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____________________________________________________ DS34T101, DS34T102, DS34T104, DS34T108
192 of 366
TDM_to_CPU_pool_level 0x04 (0x06)
Bits
Data Element Name
R/W
Reset
Value
Description
[31:8]
Reserved
-
0x0
Must be set to zero
[7:0]
Level
RO
0x0
Number of buffers currently stored in the pool. These are
the buffers that are still available to the Tx payload type
machines. Range: 0 to 128.
TDM_to_CPU_pool_thresh 0x08 (0x0A)
Bits
Data Element Name
R/W
Reset
Value
Description
[31:8]
Reserved
-
0x0
Must be set to zero
[7:0]
Threshold
RO
0x0
If the number of buffers in the pool is
this threshold, an
interrupt is generated. Range: 0 to 128.
11.4.6.2 TDM-to-CPU Queue
TDM_to_CPU_q_read 0x0C (0x0E)
Bits
Data Element Name
R/W
Reset
Value
Description
[31:13]
Reserved
-
0x0
Must be set to zero
[12:0]
Buffer ID
RO
None
Reading from this address extracts the first buffer ID from
the TDM-to-CPU queue (bits [12:0]). The buffer ID serves
as the 13 MSbs of the buffer address in the SDRAM (i.e.
corresponds to H_AD[23:11] out of 24 SDRAM address
bits).
TDM_to_CPU_q_level 0x10 (0x12)
Bits
Data Element Name
R/W
Reset
Value
Description
[31:8]
Reserved
-
0x0
Must be set to zero
[7:0]
Level
RO
0x0
Number of buffers currently stored in the queue. These
are the buffers still waiting to be handled by the CPU.
Range: 0 to 128.
TDM_to_CPU_q_thresh 0x14 (0x16)
Bits
Data Element Name
R/W
Reset
Value
Description
[31:8]
Reserved
-
0x0
Must be set to zero
[7:0]
Threshold
RO
0x0
If the number of buffers in the queue is
this threshold,
an interrupt is generated. Range: 0-128
11.4.6.3 CPU-to-ETH Queue
CPU_to_ETH_q_insert 0x18 (0x1A)
Bits
Data Element Name
R/W
Reset
Value
Description
[31:13]
Reserved
-
0x0
Must be set to zero
[12:0]
Buffer ID
WO
None
Writing to this address causes a single 13-bit buffer ID to
be inserted to the CPU-to-ETH queue. Only bits [12:0] are
written. The buffer ID serves as the 13 MSbs of the buffer
address in the SDRAM (i.e. corresponds to H_AD[23:11]
out of the 24 SDRAM address bits).
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PDF描述
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DS34T104 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip
DS34T104GN 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad TDM Over Packet Chip RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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