參數(shù)資料
型號： DS34T102GN+
廠商： Maxim Integrated Products
文件頁數(shù)： 61/366頁
文件大?。?/td> 0K
描述： IC TDM OVER PACKET 484TEBGA
產品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 30
類型： TDM（分時復用）
應用： 數(shù)據傳輸
安裝類型： 表面貼裝
封裝/外殼： 484-BGA 裸露焊盤
供應商設備封裝： 484-HSBGA（23x23）
包裝： 托盤
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____________________________________________________ DS34T101, DS34T102, DS34T104, DS34T108
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GCR1 (Global Control Register) 0x00
Bits
Data Element Name
R/W
Default
Description
1 = H_INT[1] forced inactive (high)
[0]
IPI0
R/W
0
Interrupt Pin Inhibit 0
0 = H_INT[0] normal interrupt output behavior
1 = H_INT[0] forced inactive (high)
GCR2 (Global Control Register 2) 0x04
Bits
Data Element Name
R/W
Default Description
[31:24]
Not Used
-
0
Must be set to zero.
[23:9]
Not Used
-
0
Must be set to zero.
[8]
BRPMU
R/W
0
BERT Rx Performance Monitor Update
This bit causes the Rx BERT performance monitoring registers to
be updated for all ports where local performance monitoring
update is disabled (BCR.PMUM =1). A 0 to 1 transition causes
the performance monitoring registers to be updated with the latest
data, and the counters reset. If BRPMU goes low before the local
BERT BSR.PMS bit goes high, an update might not be
performed. This bit has no for ports where BCR.PMUM=0. This is
an asynchronous signal.
[7:0]
LIUDn
R/W
0
Line Interface Unit Disable n
Bit 7 is LIUD8; bit 0 is LIUD1. When set, each of these bits
disables the corresponding internal LIU and enables the
corresponding RCLKFn and TDATFn pins for connection to an
external LIU (or other component such as an M13 mux or
SONET/SDH mapper).
0 = Internal LIU enabled
1 = Internal LIU disabled
Note: When LIUD=1, RCR3.IDF and TCR3.ODF must be set to 1
to configure the framer and formatter for NRZ data on RDATFn
and TDATFn. Also, unused LIUs can be powered down by setting
LMCR.TPDE and LMCR.RPDE.
GTRR (Global Transceiver Reset Register) 0x08
Bits
Data Element Name
R/W
Default Description
[31:19]
Not Used
-
0
Must be set to zero.
[18]
TOPRST
R/W
0
TDMoP Core Software Reset
When set, this bit resets all of the TDMoP configuration registers
to their default value.
0 = Normal operation
1 = Reset the TDMoP core
[17]
BSRST
R/W
0
BERT Software Reset
All BERT logic and registers are reset on a 0-to-1 transition of this
bit. The reset is released when a zero is written to this bit.
0 = Normal operation
1 = Reset all BERTs
[16]
FSRST
R/W
0
Framer Software Reset
All framer logic and registers are reset on a 0-to-1 transition of
this bit. The reset is released when a zero is written to this bit.
0 = Normal operation
1 = Reset all framers
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PDF描述
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DS34T104 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip
DS34T104GN 功能描述:網絡控制器與處理器 IC Quad TDM Over Packet Chip RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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