參數(shù)資料
型號： DS34T102GN+
廠商： Maxim Integrated Products
文件頁數(shù)： 170/366頁
文件大小： 0K
描述： IC TDM OVER PACKET 484TEBGA
產品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 30
類型： TDM（分時復用）
應用： 數(shù)據(jù)傳輸
安裝類型： 表面貼裝
封裝/外殼： 484-BGA 裸露焊盤
供應商設備封裝： 484-HSBGA（23x23）
包裝： 托盤
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____________________________________________________ DS34T101, DS34T102, DS34T104, DS34T108
251 of 366
0 = MECU bit is used to manually update error counter registers
1 = GCR1.GFCLE is used to manually update error counter registers
Bit 5: Manual Error Counter Update (MECU). When enabled by EAMS=1, changing this bit from zero to one
allows the next clock cycle to load the error counter registers with the latest counts and reset the counters. The
CPU must wait a minimum of 250
s before reading the error count registers to allow for proper update. See section
Bit 4: Error Counter Update Select (ECUS). This field is ignored when EAMS=1. See section 10.11.8.
T1 mode:
0 = Update error counter registers once each second
1 = Update error counter registers every 42ms (333 frames)
E1 mode:
0 = Update error counter registers once a second
1 = Update error counter registers every 62.5ms (500 frames)
Bit 3: Error Accumulation Mode Select (EAMS). See section 10.11.8.
0 = Automatic update of error counter registers. The ECUS bit determines update interval.
1 = The CPU toggles the MECU bit (per-framer manual update) when MCUS=0 or the GCR1.GFCLE bit
(global manual update) when MCUS=1 determines the update times.
Bit 2: PCVCR Fs-Bit Error Report Enable (FSBE). T1 Mode Only. See section 10.11.8.2.
0 = do not report bit errors in Fs bit positions; only Ft bit positions
1 = report bit errors in Fs bit positions as well as Ft bit positions
Bit 1: Multiframe Out-of -Sync Count Register Function Select (MOSCRF). T1 Mode Only. See section
0 = count errors in the framing bit position
1 = count the number of multiframes out of sync
Bit 0: Line Code Violation Count Register Function Select (LCVCRF). See section 10.11.8.1.
T1 mode:
0 = do not count excessive zeros
1 = count excessive zeros
E1 mode:
0 = count BPVs
1 = count code violations (CVs)
Register Name:
RHFC
Register Description:
Receive HDLC FIFO Control Register
Register Address:
base address + 0x21C
Bit #
7
6
5
4
3
2
1
0
Name
-
RFHWM1
RFHWM0
Default
0
Bits 1 to 0: Receive FIFO High Watermark Select (RFHWM[1:0]). See section 10.12.1
RFHWM1
RFHWM0
Receive FIFO Watermark
0
4 bytes
0
1
16 bytes
1
0
32 bytes
1
48 bytes
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PDF描述
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參數(shù)描述
DS34T102GN+ 功能描述:網絡控制器與處理器 IC Dual TDM Over Packet Chip RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS34T104 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip
DS34T104GN 功能描述:網絡控制器與處理器 IC Quad TDM Over Packet Chip RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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