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參數(shù)資料
| 型號： | DS34T102GN+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 298/366頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC TDM OVER PACKET 484TEBGA |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 30 |
| 類型： | TDM（分時復(fù)用） |
| 應(yīng)用： | 數(shù)據(jù)傳輸 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 484-BGA 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 484-HSBGA（23x23） |
| 包裝： | 托盤 |
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____________________________________________________ DS34T101, DS34T102, DS34T104, DS34T108
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Table 9-7. Ethernet PHY Interface Pins (MII/RMII/SSMII)
The PHY interface type is configured by General_cfg_reg0.MII_mode_select[1:0]. 00=MII, 01=Reduced MII (RMII), 11=Source Synchronous
Serial MII (SSMII). The MII interface is described in IEEE 802.3-2005 Section 22. The RMII interface is described in this document:
http://www.national.com/appinfo/networks/files/rmii_1_2.pdf. The Source Synchronous Serial MII is described in this document:
PIN NAME
PIN DESCRIPTION
CLK_MII_TX
I
MII Transmit Clock Input
In MII mode a 25MHz clock must be applied to this pin to clock the transmit side of
the interface. MII_TXD[3:0], MII_TX_EN and MII_TX_ERR are clocked out of the
device on the rising edge of CLK_MII_TX. See the timing diagram in
Figure 14-22.
In RMII mode a 50MHz clock must be applied to this pin to clock the transmit side
rising edge of CLK_MII_TX. See the timing diagram in
Figure 14-24.
In SSMII mode, a 125MHz clock must be applied to this pin. This clock is the
reference for the CLK_SSMII_TX output.
CLK_SSMII_TX
O
12ma
SSMII Transmit Clock Output
In SSMII mode, the device provides a 125MHz clock on this pin to clock the
transmit side of the interface. MII_TXD[0] (SSMII_TXD) and MII_TXD[1]
(SSMII_TX_SYNC) are clocked out of the device on the rising edge of
CLK_MII_TX. See the timing diagram in Figure 14-26. This pin is not used in MII
and RMII modes.
MII_TXD[3:0]
O
8mA
MII Transmit Data Outputs
In MII mode, transmit data is passed to the PHY four bits at a time on
MII_TXD[3:0] on the rising edge of CLK_MII_TX. See the timing diagram in
Figure 14-22.
In RMII mode, transmit data is passed to the PHY two bits at a time on
MII_TXD[3:2] on the rising edge of CLK_MII_TX while MII_TXD[1:0] are not used.
See the timing diagram in
Figure 14-24.
In SSMII mode, transmit data is passed to the PHY one bit at a time on MII_TXD[0]
(SSMII_TXD) on the rising edge of CLK_SSMII_TX. MII_TXD[1]
(SSMII_TX_SYNC) indicates 10-bit segment alignment of the serial data stream.
MII_TX_EN
O
8mA
MII Transmit Enable Output
In MII mode and RMII, this pin serves as the transmit enable output. In SSMII
mode this pin is not used.
MII_TX_ERR
O
8mA
MI Transmit Error Output
In MII mode this pin serves as the transmit error output. In RMII and SSMII modes
this pin is not used.
CLK_MII_RX
I
MII Receive Clock Input
In MII mode a 25MHz clock must be applied to this pin. MII_RXD[3:0], MII_RX_DV,
and MII_RX_ERR are clocked into the device on the rising edge of CLK_MII_RX.
See the timing diagram in Figure 14-23.
In RMII mode this pin is not used, and a 50MHz clock applied to CLK_MII_TX
provides timing for both transmit and receive sides of the interface. MII_RXD[3:2],
MII_RX_DV and MII_RX_ERR are clocked into the device on the rising edge of
CLK_MII_TX. See the timing diagram in Figure 14-25.
In SSMII mode a 125MHz clock from the PHY must be applied to this pin.
MII_RXD[0] (SSMII_RXD) and MII_RXD[1] (SSMII_RX_SYNC) are clocked into
the device on the rising edge of CLK_MII_RX. See the timing diagram in
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參數(shù)描述 |
|---|---|
| DS34T102GN+ | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Dual TDM Over Packet Chip RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS34T104 | 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip |
| DS34T104GN | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad TDM Over Packet Chip RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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