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參數(shù)資料
| 型號： | E5550F-DOW |
| 廠商： | ATMEL CORP |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | SPECIALTY TELECOM CIRCUIT, UUC7 |
| 封裝： | DIE-7 |
| 文件頁數(shù)： | 682/1069頁 |
| 文件大?。?/td> | 14303K |
| 代理商： | E5550F-DOW |
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682
SAM4CP [DATASHEET]
43051E–ATPL–08/14
Figure 34-11. Master Read Wait State with Multiple Data Bytes
34.7.3.6 Internal Address
The TWI interface can perform transfers with 7-bit slave address devices and 10-bit slave address devices.
7-bit Slave Addressing
When Addressing 7-bit slave devices, the internal address bytes are used to perform random address (read or write)
accesses to reach one or more data bytes, e.g. within a memory page location in a serial memory. When performing read
operations with an internal address, the TWI performs a write operation to set the internal address into the slave device,
and then switch to Master Receiver mode. Note that the second start condition (after sending the IADR) is sometimes
called “repeated start” (Sr) in I
2
C fully-compatible devices. See
Figure 34-13
. See
Figure 34-12
and
Figure 34-14
for
Master Write operation with internal address.
The three internal address bytes are configurable through the Master Mode register (TWI_MMR).
If the slave device supports only a 7-bit address, i.e., no internal address, IADRSZ must be set to 0.
Table 34-6
shows the abbreviations used in
Figure 34-12
and
Figure 34-13
.
A
DATA n
A
S
DADR
W
DATA n+1
A
P
DATA n+2
A
TXCOMP
RXRDY
Read RHR (Data n)
STOP command performed
(by writing in the TWI_CR)
TWD
TWCK
Read RHR (Data n+1)
Read RHR (Data n+2)
Clock Wait State
Table 34-6.
Abbreviations
Abbreviation
Definition
S
Start
Sr
Repeated Start
P
Stop
W
Write
R
Read
A
Acknowledge
NA
Not Acknowledge
DADR
Device Address
IADR
Internal Address
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| E5530H-230-DOW | SPECIALTY TELECOM CIRCUIT, UUC |
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| ECM2A5C3A32-34.400M | QUARTZ CRYSTAL RESONATOR, 34.4 MHz |
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參數(shù)描述 |
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