參數(shù)資料
型號(hào)： EVAL-ADAU1442EBZ
廠商： Analog Devices Inc
文件頁數(shù)： 28/93頁
文件大?。?/td> 0K
描述： BOARD EVAL FOR ADAU1442
標(biāo)準(zhǔn)包裝： 1
系列： SigmaDSP®
主要目的： 音頻，音頻處理
嵌入式： 是，DSP
已用 IC / 零件： ADAU1442
主要屬性： 單芯片多通道 28/56 位音頻 DSP
次要屬性： I²C & SPI 接口
已供物品： 電路板，線纜，說明文檔，GPIO 子板，電源
Data Sheet
ADAU1442/ADAU1445/ADAU1446
Rev. D | Page 33 of 92
Serial Audio Data Timing Diagrams
Figure 22 to Figure 26 show timing diagrams for standard audio data formats.
MSB
LEFT CHANNEL
LSB
MSB
RIGHT CHANNEL
LSB
1/FS
07696-
021
LRCLKx
BCLKx
SDATA_INx,
SDATA_OUTx
Figure 22. I2S Mode—16 Bits to 24 Bits per Channel
LEFT CHANNEL
MSB
LSB
MSB
RIGHT CHANNEL
LSB
1/FS
07696-
022
LRCLKx
BCLKx
SDATA_INx,
SDATA_OUTx
Figure 23. Left-Justified Mode—16 Bits to 24 Bits per Channel
LRCLKx
BCLKx
LEFT CHANNEL
MSB
LSB
MSB
RIGHT CHANNEL
LSB
1/FS
07696-
023
SDATA_INx,
SDATA_OUTx
Figure 24. Right-Justified Mode—16 Bits to 24 Bits per Channel
LRCLKx
BCLKx
SDATA_INx,
SDATA_OUTx
SLOT 1
SLOT 4
SLOT 5
32 BCLKs
MSB
MSB – 1
MSB – 2
256 BCLKs
SLOT 2
SLOT 3
SLOT 6
SLOT 7
SLOT 8
LRCLK
BCLK
DATA
07696-
024
Figure 25. TDM Mode
SLOT 0
SLOT 1
SLOT 2
SLOT 3
SLOT 4
SLOT 5
SLOT 6
SLOT 7
CH
0
CH
8
MSB TDM
32
BCLKs
MSB TDM
07696-
025
LRCLKx
BCLKx
SDATA_INx,
SDATA_OUTx
Figure 26. TDM Mode with Pulse Frame Clock
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PDF描述
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參數(shù)描述
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