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參數(shù)資料
| 型號： | MB90P663AP-SH |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, OTPROM, 16 MHz, MICROCONTROLLER, PDIP64 |
| 封裝： | PLASTIC, SHRINK, DIP-64 |
| 文件頁數(shù)： | 5/284頁 |
| 文件大?。?/td> | 2703K |
| 代理商： | MB90P663AP-SH |
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2.4 Multi-Function Timer
97
b) Pin Control Block
The pin control block has 4 channels, and controls setting/resetting of the real-time output signal
pins (RT0 to RT3) according to compare-detection events and zero-detection events involving the
14-bit timer.
(1) Compare/Port Switching Operation
The COER register determines whether the RT0 to RT3 signals function as PDBR output, or as
real-time output pins.
This register controls the internal signals RT0 to RT3, and when the DTCR register is used to
setup the dead-time timer for 3-phase waveform output, a non-overlapping waveform can be
generated over any of the bits RT1 to RT3 selected here, and output over the six pins U to Z.
Table 2.4.1 External Pin Function Selection
The initial value of the PWM output (RT0 to RT3) is undefined. When setting initial values for
these signal pins, the values in the PDR6 register should be set first, before output is enabled.
(2) Compare-Match Detect Operation (Output Compare Register)
Compare-match detection operates by continuous comparison of timer values with values in the
OCPR register. When a match event occurs, a set/reset/transfer control signal is output to PDR
accrding to the setting in the OCTR register, and at the same time the CIR bit in the CICR
register for the corresponding compare register is set.
(3) Buffer Transfer Enable/Disable Control
Setting the TREN bit in the CMCR register to ‘0’ disables all four channels for transfer from the
output compare buffer register to the output compare register. Thus any transfer sources
generated while the TREN bit is set to ‘0’ will be ignored.
Once ‘1’ is written to the TREN bit, transfer operations from the buffer register will start with the
generation of the next transfer source.
The TREN bit also controls transfer from the compare clear buffer register to the compare clear
register.
In addition, this bit also controls transfers while the timer is stopped.
COER
register
RTOx
bit
DTCR
register
DT1 bit
DDR
register
P6x bit
External pin operations
X
0
High-impedance state, functions as input pin
0
1
Functions as PDBR output
1
0
1
Functions as real-time output pin
0
1
Dead-time control output for PDBR output pins
1
Dead-time control output for real-time output pins
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PDF描述 |
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